參數(shù)資料
型號(hào)： PNX9520E
廠商： NXP Semiconductors N.V.
元件分類： 數(shù)字信號(hào)處理
英文描述： Connected media processor
封裝： PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1<Always Pb-free,;PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1
文件頁(yè)數(shù)： 96/828頁(yè)
文件大?。?/td> 3775K
代理商： PNX9520E
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NXP Semiconductors
PNX15xx/952x Series
Volume 1 of 1
Chapter 5: The Clock Module
PNX15XX_PNX952X_SER_N_4
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 4.0 — 03 December 2007
5-185
Offset 0x04,7008
PLL2_CTL
Reset values set for expected frequencies for faster boot-up, shorter boot code.
31:30
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
29
Turn Off Acknowledge
R
-
Indicates that during a frequency change that the clock has been
driven low.
28
PLL Lock
R
-
A one indicates that the PLL is locked
27:24
pll2_adj
R/W
0
Current adjustment. Section 2.2.1 on page 5-158.
23:21
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
20:12
pll2_n
R/W
0x2E
9-bit N parameter to PLL2. Section 2.2.1 on page 5-158.
11:10
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
9:4
pll2_m
R/W
0x5
6-bit M parameter to PLL2. Section 2.2.1 on page 5-158.
3:2
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
1
pll2_pd
R/W
0
1: powerdown PLL2
0
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
Offset 0x04,700C
PLL1_7GHZ_CTL
31:3
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
2
pll1_7ghz_pd
R/W
0
1: powerdown PLL1_7GHZ
1:0
Reserved
R/W
-
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
DDS Registers
Offset 0x04,7010
DDS0_CTL
31
Enable
R/W
0
1: Enables the DDS. The input of the DDS is then the 1.7GHz clock.
0: Test mode. Do not use.
30:0
dds0_ctl[30
:0]
R/W
0x07684
bd0
31-bit DDS0 control (default = 50 MHz)
Offset 0x04,7014
DDS1_CTL
31
Enable
R/W
0
1: Enables the DDS. The input of the DDS is then the 1.7GHz clock.
0: Test mode. Do not use.
30:0
dds1_ctl[30:0]
R/W
0x04000
000
31-bit DDS1 control (default = 27 MHz)
Offset 0x04,7018
DDS2_CTL
31
Enable
R/W
0
1: Enables the DDS. The input of the DDS is then the 1.7GHz clock.
0: Test mode. Do not use.
30:0
dds2_ctl[30:0]
R/W
0x04000
000
31-bit DDS2 control (default = 27 MHz)
Table 11: CLOCK MODULE REGISTERS …Continued
Bit
Symbol
Acces
s
Value
Description
相關(guān)PDF資料
PDF描述
POE-A CERAMIC RESONATORS
POE-B CERAMIC RESONATORS
POS-50 VCO, 25 MHz - 50 MHz
POS-ED5319/1 VCO, 75 MHz - 114 MHz
PP156TWRG4-6VAC-W12 DUAL COLOR LED, RED/GREEN, 4 mm
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PNX9520E/N1/S422,5 制造商:NXP Semiconductors 功能描述:- Tape and Reel
PNY CARRYING CHARGE 制造商:PNY Technologies 功能描述:PNY CARRYING CHARGE - Virtual or Non-Physical Inventory (Software & Literature)
PNY-05015 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS
PNY-07006 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS
PNY-12206 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS
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