參數(shù)資料
型號(hào)： PNX9520E
廠商： NXP Semiconductors N.V.
元件分類： 數(shù)字信號(hào)處理
英文描述： Connected media processor
封裝： PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1<Always Pb-free,;PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1
文件頁(yè)數(shù)： 658/828頁(yè)
文件大?。?/td> 3775K
代理商： PNX9520E
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NXP Semiconductors
PNX15xx/952x Series
Volume 1 of 1
Chapter 23: LAN100 — Ethernet Media Access Controller
PNX15XX_PNX952X_SER_N_4
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 4.0 — 03 December 2007
23-691
31:0
HashFilterL
R/W
Bit 31:0 of the imperfect lter hash table for receive ltering.
Offset 0x07 2214
Hash lter table MSBs register (HashFilterH)
31:0
HashFilterH
R/W
Bit 63:32 of the imperfect lter hash table for receive ltering.
Offset 0x07 2230/40/50/60 PatternMatch Unit 0/1/2/3 Mask LSBs Register (PatternMatchMask0/1/2/3L)
The PatternMatchMask registers specify a mask for the pattern matching windows so that some bytes can be masked out in
the CRC calculation.
The PatternMatchMask consists of 64 byte-enable signals, one for each byte in the pattern-matching window. The
pattern-matching mask is distributed over two 32-bit registers. The LAN100 has four pattern-matching units.
31:0
PatternMatchMask0/1/2/
3L
R/W
Bits 31:0 of the pattern-matching mask for lter unit 0/1/2/3. Each bit
represents a byte-enable in the pattern-matching window.
Offset 0x07 2234/44/54/64 PatternMatch Unit 0/1/2/3 Mask MSBs Register (PatternMatchMask0/1/2/3H)
The PatternMatchMask registers specify a mask for the pattern matching windows so that some bytes can be masked out in
the CRC calculation.
The PatternMatchMask consists of 64 byte-enable signals, one for each byte in the pattern-matching window. The pattern
matching mask is distributed over two 32-bit registers. The LAN100 has four pattern-matching units.
31:0
PatternMatchMask0/1/2/
3H
R/W
Bits 63:32 of the pattern-matching mask for lter unit 0/1/2/3. Each
bit represents a byte-enable in the pattern-matching window.
Offset 0x07 2238/48/58/68 PatternMatch Unit 0/1/2/3 CRC Register (PatternMatchCRC0/1/2/3)
Each of the four pattern-matching lters calculates a 32-bit CRC on a 64-byte window. If the CRC matches the 32-bit golden
CRC value in the lter unit’s CRC register, a match is found.
31:0
PatternMatchCRC0/1/2/
3
R/W
The golden CRC for pattern-matching lter unit 0/1/2/3.
Offset 0x07 223C/4C/5C/6C PatternMatch Unit 0/1/2/3 Skip Bytes (PatternMatchSkip0/1/2/3)
Each of the four pattern-matching lters calculates a 32-bit CRC on a 64-byte window. The window can have an offset with
respect to the start of the frame. The Pattern Match Unit 0/1/2/3 Skip Bytes register species the number of bytes that must
be skipped before starting the window.
31:0
PatternMatchSkip0/1/2/3 R/W
The number of bytes in a frame that need to be skipped before
starting pattern-matching ltering in unit 0/1/2/3.
Offset 0x07 2FE0
Interrupt Status Register (IntStatus)
The interrupt status register is read-only. Bits can be set via the IntSet register. Bits can be cleared via the IntClear register.
31:14
-
Unused
13
WakeupInt
RO
Interrupt was triggered by a Wakeup event detected by the receive
lter.
12
SoftInt
RO
Interrupt was triggered by software writing a 1 in the IntSet register.
11
TxRtDoneInt
RO
Interrupt was triggered because a real-time descriptor was
transmitted and the Interrupt bit in its descriptor was set.
10
TxRtFinishedInt
RO
Interrupt was triggered because all real-time descriptors have been
processed, so that now ProduceIndex == ConsumeIndex.
9
TxRtErrorInt
RO
Interrupt was triggered on real-time transmit errors: LateCollision,
ExcessiveCollision, ExcessiveDefer, and NoDescriptor or Underrun.
8
TxRtUnderrunInt
RO
Interrupt set on a fatal underrun error in the real-time transmit
queue. The fatal interrupt should be resolved by a Tx soft-reset. The
bit is not set in case of a non fatal underrun error.
Table 2: LAN100 Registers …Continued
Bit
Symbol
Acces
s
Value
Description
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PDF描述
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PNY-12206 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS
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