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參數(shù)資料
| 型號(hào)： | T7633 |
| 廠商： | Lineage Power |
| 英文描述： | Dual T1/E1 3.3 V Short-Haul Terminator(雙T1/E1 3.3V短通信距離終端器) |
| 中文描述： | 雙T1/E1的3.3伏短途終結(jié)者（雙T1/E1的3.3短通信距離終端器） |
| 文件頁數(shù)： | 22/248頁 |
| 文件大?。?/td> | 1459K |
| 代理商： | T7633 |
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Advance Data Sheet
T7633 Dual T1/E1 3.3 V Short-Haul Terminator
May 1998
12
Lucent Technologies Inc.
List of Tables
(continued)
Table
Page
Table 191. FDL Register FDL_PR7...................................................................................................................... 215
Table 192. FDL Receiver Match Character Register (FDL_PR8) (808; E08)....................................................... 215
Table 193. FDL Transparent Control Register (FDL_PR9) (809; E09) ................................................................ 216
Table 194. FDL Transmit ANSI ESF Bit Codes (FDL_PR10) (80A; E0A)............................................................ 216
Table 195. FDL Interrupt Status Register (Clear on Read) (FDL_SR0) (80B; E0B) ............................................ 217
Table 196. FDL Transmitter Status Register (FDL_SR1) (80C; E0C).................................................................. 218
Table 197. FDL Receiver Status Register (FDL_SR2) (80D; E0D)...................................................................... 218
Table 198. Receive ANSI FDL Status Register (FDL_SR3) (80E; E0E).............................................................. 218
Table 199. FDL Receiver FIFO Register (FDL_SR4) (807; E07)......................................................................... 218
Table 200. Global Register Set ............................................................................................................................ 219
Table 201. Line Interface Unit Register Set.......................................................................................................... 219
Table 202. Framer Unit Status Register Map....................................................................................................... 220
Table 203. Receive Signaling Registers Map....................................................................................................... 222
Table 204. Framer Unit Parameter Register Map ................................................................................................ 223
Table 205. Transmit Signaling Registers Map...................................................................................................... 226
Table 206. Facility Data Link Register Map.......................................................................................................... 227
Table 207. ESD Threshold Voltage...................................................................................................................... 228
Table 208. Logic Interface Characteristics (T
A
= –40
°
C to 85
°
C, V
DD
= 3.3 V
±
5%, V
SS
= 0).......................... 229
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