參數(shù)資料
型號: T7633
廠商: Lineage Power
英文描述: Dual T1/E1 3.3 V Short-Haul Terminator(雙T1/E1 3.3V短通信距離終端器)
中文描述: 雙T1/E1的3.3伏短途終結(jié)者(雙T1/E1的3.3短通信距離終端器)
文件頁數(shù): 197/248頁
文件大小: 1459K
代理商: T7633
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Advance Data Sheet
May 1998
T7633 Dual T1/E1 3.3 V Short-Haul Terminator
187
Lucent Technologies Inc.
Framer Register Architecture
(continued)
Framer Parameter/Control Registers
(continued)
ET1 Remote End Errored Event Enable Register
1
(FRM_PR15)
These bits enable the errored events used to determine errored and severely errored seconds at the ET's remote
end interface.
ETRESa6-F
,
ETRESa6-E
,
ETRESa6-8
,
ETRERFA
,
ETRESLIP
,
ETREAIS
,
ETRELMFA
, and
ETRELFA
are the
Sa6-F
,
Sa6-E
,
Sa6-8
,
RFA
,
SLIP
,
AIS
,
LMFA
, and
LFA
errored events, respectively, as referred to the ET
remote end interface. A 1 in the bit position enables the corresponding errored event. The default value of this reg-
ister is 00 (hex).
Table 143. ET1 Remote End Errored Event Enable Register (FRM_PR15) (66F; C6F)
NT1 Errored Event Enable Register
1
(FRM_PR16)
These bits enable the errored events used to determine errored and severely errored seconds at the network ter-
mination-1 interface. NTSa6-C, NTSa6-8, NTSLIP, NTAIS, NTLMFA, and NTLFA are the Sa6-C, Sa6-8, SLIP, AIS,
LMFA, and LFA errored events, respectively, as referred to the NT1 interface. A 1 in the bit position enables the cor-
responding errored event. The default value of this register is 00 (hex).
Table 144. NT1 Errored Event Enable Register (FRM_PR16) (670; C70)
NT1 Remote End Errored Event Enable Register
1
(FRM_PR17—FRM_PR18)
These bits enable the errored events used to determine errored and severely errored seconds at the network ter-
mination-1 remote end interface. NTRERFA, NTRESLIP, NTREAIS, NTRELMFA, NTRELFA, NTRESa6-C,
NTRESa6-F, NTRESa6-E, and NTRESa6-8 are the RFA, SLIP, AIS, LMFA, LFA, Sa6-C, Sa6-F, Sa6-E, and Sa6-8
errored events, respectively, as referred to the NT-1 remote end interface. The default value of this register is 00
(hex).
Table 145. NT1 Remote End Errored Event Enable Registers (FRM_PR17—FRM_PR18) ((671—672);
(C71—C72))
1. One occurrence of any one of these events causes an errored second count increment and a severely errored second count increment.
Register
FRM_PR15
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ETRESa6-F ETRESa6-E ETRESa6-8 ETRERFA ETRESLIP ETREAIS ETRELMFA ETRELFA
Register
FRM_PR16
Bit 7
NTSa6-C
Bit 6
0
Bit 5
NTSa6-8
Bit 4
0
Bit 3
NTSLIP
Bit 2
NTAIS
Bit 1
NTLMFA
Bit 0
NTLFA
Register
FRM_PR17
FRM_PR18
Bit 7
0
0
Bit 6
0
0
Bit 5
0
0
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
NTRERFA
0
NTRESLIP
NTRESa6-C NTRESa6-F NTRESa6-E
NTREAIS
NTRELMFA
NTRELFA
NTRESa6-8
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