參數(shù)資料
型號(hào)： μPD98405
廠(chǎng)商： NEC Corp.
英文描述： 155M ATM Integrated SAR Controller(155M ATM SAR集成控制器)
中文描述： 155M章綜合特區(qū)控制器自動(dòng)柜員機(jī)（155M章自動(dòng)柜員機(jī)特區(qū)集成控制器）
文件頁(yè)數(shù)： 14/391頁(yè)
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代理商： ΜPD98405
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LIST OF FIGURES (2/4)
Figure No. Title Page
4-28
EEPROM Interface Timing ............................................................................................96
4-29
PHY Layer Interface for Data and Control.....................................................................99
4-30
Transmit Timing in Octet-Level Handshaking Mode....................................................101
4-31
Transmit Timing in Cell-Level Handshaking Mode......................................................102
4-32
Receive Timing in Octet-Level Handshaking Mode.....................................................103
4-33
Receive Timing in Cell-Level Handshaking Mode.......................................................104
4-34
External FIFO Connection Block Diagram...................................................................105
4-35
PHY Device Control Signal Timing..............................................................................107
4-36
Control Memory Interface Using Standard SRAMs.....................................................108
4-37
Control Memory Access Timing...................................................................................110
4-38
Example of Connecting the PMD Interface (Connecting 5-V Optical Module)............111
4-39
Synthesizer Reference Clock ......................................................................................112
4-40
Example of Connection in External Clock Recovery Mode.........................................113
5-1
Control Memory after Initialization ...............................................................................116
5-2
Initialization Sequence Flowchart ................................................................................118
5-3
Control Memory Configuration.....................................................................................121
5-4
Free Block Pool Stack .................................................................................................122
5-5
Mailbox Structure.........................................................................................................125
5-6
Outline of Transmission Flow.......................................................................................127
5-7
Structure of Transmit Data in System Memory............................................................128
5-8
Format of Packet Descriptor........................................................................................129
5-9
Location of Vacant Descriptor......................................................................................130
5-10
Location of Transmit Queue ........................................................................................131
5-11
Single-Buffer Mode......................................................................................................131
5-12
Multi-Buffer Mode.........................................................................................................132
5-13
Transmit Queue Containing Interrupt Mask Packets...................................................134
5-14
Inserting CRC-10.........................................................................................................134
5-15
Format of Buffer Descriptor .........................................................................................136
5-16
Setting of LAST Bit.......................................................................................................137
5-17
Transmit VC Table.......................................................................................................139
5-18
Status Transition of Transmit Channel ........................................................................144
5-19
Final User Abort Cell....................................................................................................144
5-20
Concept of Scheduling.................................................................................................147
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PDF描述
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PD9933-59 制造商:Philco/Philips 功能描述:
PD9941-59 制造商:Philco/Philips 功能描述:
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