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參數(shù)資料
| 型號(hào)： | TMX320DM6446ZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)芯片 |
| 文件頁數(shù)： | 30/214頁 |
| 文件大小： | 1699K |
| 代理商： | TMX320DM6446ZWT |
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www.ti.com
P
TMS320DM6446
Digital Media System on-Chip
SPRS283–DECEMBER 2005
Table 2-10. Oscillator/PLL Terminal Functions
SIGNAL
NAME
IPD/
IPU
(2)
TYPE
(1)
DESCRIPTION
NO.
OSCILLATOR, PLL
Crystal input MXI for MX oscillator (system oscillator, typically 27 MHz).
If the internal oscillator is bypassed, this is the external oscillator clock input.
Crystal output for MX oscillator
1.8V power supply for MX oscillator
Ground for MX oscillator
Crystal input for M24 oscillator (24 MHz for USB)
Crystal output for M24 oscillator
1.8V power supply for M24 oscillator
Ground for M24 oscillator
1.8 Volt power supply for PLLs (system and USB)
Core voltage reference for PLL logic and bandgap backup
MXI/
CLKIN
MXO
MXV
DD
MXV
SS
M24XI
M24XO
M24V
DD
M24V
SS
PLLV
DD18
APLLREFV
L1
I
M1
L5
L2
F18
F19
F16
F17
M2
M3
O
S
GND
I
O
S
GND
S
S
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
IPD = Internal pulldown, IPU = Internal pullup. (To pull up a signal to the opposite supply rail, a 1-k
resistor should be used.)
Table 2-11. Clock Generator Terminal Functions
SIGNAL
NAME
IPD/
IPU
(2)
TYPE
(1)
DESCRIPTION
NO.
CLOCK GENERATOR
This pin is multiplexed between the PLL1 clock generator and GPIO. For the PLL1
clock generator, it is clock output CLK_OUT0. This is configurable for 13.5 MHz or
27 MHz clock outputs.
For GPIO, it is GPIO48 [default].
This pin is multiplexed between the USB clock generator, timer, and GPIO. For
the USB clock generator, it is clock output CLK_OUT1. This is configurable for 12
MHz or 24 MHz clock outputs.
For Timer0, it is the timer event capture input TIM_IN.
For GPIO, it is GPIO49 [default].
CLK_OUT0/
GPIO48
K1
I/O/Z
IPD
CLK_OUT1/
TIM_IN/
GPIO49
E19
I/O/Z
IPD
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
IPD = Internal pulldown, IPU = Internal pullup. (To pull up a signal to the opposite supply rail, a 1-k
resistor should be used.)
Table 2-12. RESET and JTAG Terminal Functions
SIGNAL
NAME
IPD/
IPU
(2)
TYPE
(1)
DESCRIPTION
NO.
RESET
RESET
L4
I
IPU
This is the active low Global reset input.
JTAG
TMS
TDO
TDI
TCK
RTCK
E6
B5
A5
A6
B6
I
IPU
JTAG test-port mode select input
JTAG test-port data output
JTAG test-port data input
JTAG test-port clock input
JTAG test-port return clock output
O/Z
I
I
O/Z
IPU
IPU
JTAG test-port reset. For IEEE 1149.1 JTAG compatibility, see the IEEE 1149.1
JTAG compatibility statement portion of this data sheet.
Emulation pin 1
Emulation pin 0
TRST
D7
I
IPD
EMU1
EMU0
C6
D6
I/O/Z
I/O/Z
IPU
IPU
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
IPD = Internal pulldown, IPU = Internal pullup. (To pull up a signal to the opposite supply rail, a 1-k
resistor should be used.)
Device Overview
30
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TN28F010-90 | 28F010 1024K (128K X 8) CMOS FLASH MEMORY |
| TN28F010-120 | 28F010 1024K (128K X 8) CMOS FLASH MEMORY |
| TN28F010-150 | 28F010 1024K (128K X 8) CMOS FLASH MEMORY |
| TN28F020-90 | 28F020 2048K (256K X 8) CMOS FLASH MEMORY |
| TN28F020-150 | 28F020 2048K (256K X 8) CMOS FLASH MEMORY |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMX320DM6467TZUT1 | 制造商:Texas Instruments 功能描述: |
| TMX320DM6467ZUT | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Dig Media System-on- Chip RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| TMX320DM647ZUT720 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Digital Media Processor |
| TMX320DM647ZUT900 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Digital Media Processor |
| TMX320DM648ACUT7 | 制造商:Texas Instruments 功能描述:- Trays |
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