參數(shù)資料
型號： TMX320DM6446ZWT
廠商： Texas Instruments, Inc.
英文描述： Digital Media System on-Chip
中文描述： 數(shù)字媒體系統(tǒng)芯片
文件頁數(shù)： 137/214頁
文件大?。?/td> 1699K
代理商： TMX320DM6446ZWT
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www.ti.com
P
TMS320DM6446
Digital Media System on-Chip
SPRS283–DECEMBER 2005
5.11.2.2
ATA/CF Multiword DMA Timing
Table 5-35. Timings for ATA/CF Module --- Multiword DMA AC Timing (see
Figure 5-22
)
-594
NO.
UNIT
MODE
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
0
1
2
MIN
480
150
120
215
80
70
MAX
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1
t
0
Cycle time
2
t
D
DIOW/DIOR active low pulse duration
150
60
50
3
t
E
DIOR data access, DIOR falling edge to DD[15:0] valid
5
5
5
DIOR data hold time, DD[15:0] valid after DIOR rising
edge
4
t
F
100
30
20
20
15
10
DIOW/DIOR data setup time, DD[15:0] valid before
DIOW/DIOR rising edge
5
t
G
DIOW data hold time, DD[15:0] valid after DIOW rising
edge
6
t
H
0
0
0
7
t
I
DMACK to DIOW/DIOR setup
20
8
t
J
DIOW/DIOR to DMACK hold
5
5
50
50
25
215
50
25
9
t
KR
DIOR negated pulse width
10
t
KW
DIOW negated pulse width
120
45
35
40
40
35
11
t
LR
DIOR to DMARQ delay
12
t
LW
DIOW to DMARQ delay
50
30
25
15
10
10
13
t
M
ATA_CSx valid to DIOW/DIOR setup
14
t
N
ATA_CSx valid after DIOW/DIOR rising edge hold
Peripheral and Electrical Specifications
137
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