參數(shù)資料
型號： TMX320DM6446ZWT
廠商： Texas Instruments, Inc.
英文描述： Digital Media System on-Chip
中文描述： 數(shù)字媒體系統(tǒng)芯片
文件頁數(shù)： 165/214頁
文件大?。?/td> 1699K
代理商： TMX320DM6446ZWT
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www.ti.com
P
TMS320DM6446
Digital Media System on-Chip
SPRS283–DECEMBER 2005
Various Output Formats
–
YCbCr 16bit
–
YCbCr 8bit
–
ITU-R BT. 656
–
Parallel RGB 24bit
Low Pass Filter for Digital RGB Output
Programmable Timing Generator
Master/Slave Operation
Internal Color Bar Generation (100%/75%)
The VENC register memory mapping including the Digital LCD and DACs is shown in
Table 5-54
.
Table 5-54. VENC (Including Digital LCD and DACs) Register Descriptions
Address
0x01C7 2400
0x01C7 2404
0x01C7 2408
0x01C7 240C
0x01C7 2410
0x01C7 2414
0x01C7 2418
0x01C7 241C
0x01C7 2420
0x01C7 2424
0x01C7 2428
0x01C7 242C
0x01C7 2430
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0x01C7 2460
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0x01C7 246C
0x01C7 2470
0x01C7 2474
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0x01C7 247C
0x01C7 2480
0x01C7 2484
0x01C7 2488
Register
Description
VMOD
VIDCTL
VDPRO
SYNCCTL
HSPLS
VSPLS
HINT
HSTART
HVALID
VINT
VSTART
VVALID
HSDLY
VSDLY
YCCTL
RGBCTL
RGBCLP
LINECTL
CULLLINE
LCDOUT
BRTS
BRTW
ACCTL
PWMP
PWMW
DCLKCTL
DCLKPTN0
DCLKPTN1
DCLKPTN2
DCLKPTN3
DCLKPTN0A
DCLKPTN1A
DCLKPTN2A
DCLKPTN3A
DCLKHS
Video Mode
Video Interface I/O Control
Video Data Processing
Sync Control
Horizontal Sync Pulse Width
Vertical Sync Pulse Width
Horizontal Interval
Horizontal Valid Data Start Position
Horizontal Data Valid Range
Vertical Interval
Vertical Valid Data Start Position
Vertical Data Valid Range
Horizontal Sync Delay
Veritcal Sync Delay
YCbCr Control
RGB Control
RGB Level Clipping
Line Id Control
Culling line control
LCD Output Signal Control
Brightness Start Position Signal Control
Brightness Width Signal Control
LCD_AC Signal Control
PWM Start Position Signal Control
PWM Width Signal Control
DCLK Control
DCLK Pattern 0
DCLK Pattern 1
DCLK Pattern 2
DCLK Pattern 3
DCLK Auxiliary Pattern 0
DCLK Auxiliary Pattern 1
DCLK Auxiliary Pattern 2
DCLK Auxiliary Pattern 3
Horizontal DCLK Mask Atart
Peripheral and Electrical Specifications
165
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