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參數(shù)資料
| 型號： | UPD70F3214HGC-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 533/861頁 |
| 文件大?。?/td> | 3910K |
| 代理商： | UPD70F3214HGC-8EU |
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CHAPTER 19 I
2
C BUS
User’s Manual U16890EJ1V0UD
533
(2/4)
SPIE0
Enable/disable generation of interrupt request when stop condition is detected
0
Disable
1
Enable
Condition for clearing (SPIE0 bit = 0)
Note
Condition for setting (SPIE0 bit = 1)
Cleared by instruction
Reset
Set by instruction
WTIM0
Control of wait and interrupt request generation
0
Interrupt request is generated at the eighth clock’s falling edge.
Master mode: After output of eight clocks, clock output is set to low level and wait is set.
Slave mode: After input of eight clocks, the clock is set to low level and wait is set for master device.
1
Interrupt request is generated at the ninth clock’s falling edge.
Master mode: After output of nine clocks, clock output is set to low level and wait is set.
Slave mode: After input of nine clocks, the clock is set to low level and wait is set for master device.
An interrupt is generated at the falling of the 9th clock during address transfer independently of the setting of this bit.
The setting of this bit is valid when the address transfer is completed. When in master mode, a wait is inserted at the
falling edge of the ninth clock during address transfers. For a slave device that has received a local address, a wait is
inserted at the falling edge of the ninth clock after an acknowledge signal (ACK) is issued. However, when the slave
device has received an extension code, a wait is inserted at the falling edge of the eighth clock.
Condition for clearing (WTIM0 bit = 0)
Note
Condition for setting (WTIM0 bit = 1)
Cleared by instruction
Reset
Set by instruction
ACKE0
Acknowledgment control
0
Disable acknowledgment.
1
Enable acknowledgment. During the ninth clock period, the SDA0 line is set to low level. However, ACK is
invalid during address transfers and other than in expansion mode.
Condition for clearing (ACKE0 bit = 0)
Note
Condition for setting (ACKE0 bit = 1)
Cleared by instruction
Reset
Set by instruction
Note
This flag’s signal is invalid when the IICE0 bit = 0.
相關PDF資料 |
PDF描述 |
|---|---|
| UPD70F3214HY | 32-Bit Single-Chip Microcontrollers |
| UPD71011 | COCK PULSE GENERATOR/DIRVER |
| UPD71011C-10 | COCK PULSE GENERATOR/DIRVER |
| UPD71011C-8 | COCK PULSE GENERATOR/DIRVER |
| UPD71011G-8 | COCK PULSE GENERATOR/DIRVER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| UPD70F3214HY | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3216 | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3217 | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3217A | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3217GJA-UEN | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
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