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參數(shù)資料
| 型號(hào)： | UPD70F3214HGC-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁(yè)數(shù)： | 443/861頁(yè) |
| 文件大?。?/td> | 3910K |
| 代理商： | UPD70F3214HGC-8EU |
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CHAPTER 16 ASYNCHRONOUS SERIAL INTERFACE (UART)
User’s Manual U16890EJ1V0UD
443
(2) Asynchronous serial interface status register n (ASISn)
The ASISn register, which consists of 3 error flag bits (PEn, FEn and OVEn), indicates the error status when
UARTn reception is complete.
The ASISn register is cleared to 00H by a read operation. When a reception error occurs, the RXBn register
should be read and the error flag should be cleared after the ASISn register is read.
This register is read-only, in 8-bit units.
After reset, ASISn is set to 00H.
Cautions 1. When the ASIMn.UARTEn bit or ASIMn.RXEn bit is cleared to 0, or when the ASISn
register is read, the PEn, FEn, and OVEn bits are cleared (0).
2. Operation using a bit manipulation instruction is prohibited.
3. When the main clock is stopped and the CPU is operating on the subclock, do not
access the ASISn register using an access method that causes a wait.
For details, refer to 3.4.8 (2).
7
0
ASISn
(n = 0, 1)
6
0
5
0
4
0
3
0
2
PEn
1
FEn
0
OVEn
After reset: 00H R Address: ASIS0 FFFFFA03H, ASIS1 FFFFFA13H
PEn
Status flag indicating a parity error
0
When the UARTEn or RXEn bit is cleared to 0, or after the ASISn register has been read
1
When reception was completed, the receive data parity did not match the parity bit
The operation of the PEn bit differs according to the settings of the ASIMn.PSn1 and ASIMn.PSn0 bits.
FEn
Status flag indicating framing error
0
When the UARTEn or RXEn bit is cleared to 0, or after the ASISn register has been read
1
When reception was completed, no stop bit was detected
For receive data stop bits, only the first bit is checked regardless of the stop bit length.
OVEn
Status flag indicating an overrun error
0
When the UARTEn or RXEn bit is cleared to 0, or after the ASISn register has been read.
1
UARTn completed the next receive operation before reading receive data of the RXBn register.
When an overrun error occurs, the next receive data value is not written to the RXBn register and the data is
discarded.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| UPD70F3217 | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3217A | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
| UPD70F3217GJA-UEN | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
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