參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁(yè)數(shù)： 219/784頁(yè)
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
11 M13/M23 MUX/DeMUX Registers
(continued)
219
Agere Systems Inc.
Table 272. M13_CONTROL3, Control 3 (R/W)
Address
Bit
Table 273. M13_SP_OFFSET_R, Sync Pulse Offset (R/W)
Table 274. M13_SP_D_OFFSET_R, Sync Pulse D Offset (R/W)
0x1005C
3
M13_AUTO_AIS_LOF
M13_AUTO_AIS_LOF Bit.
If this bit is 1, the M13 will auto-
matically insert AIS in all DS2 outputs of the M23 demulti-
plexer when M13_DS3_LOF = 1 (
Table 236 on page 208
),
and it will automatically insert AIS in all DS1 or E1 outputs of
M12 demultiplexer
Y
when M13_DS2_LOFy = 1 (
Table 253
on page 213
).
M13_AUTO_AIS_
OOF
matically insert AIS in all DS2 outputs of the M23 demulti-
plexer when M13_DS3_OOF = 1 (
Table 236 on page 208
),
and it will automatically insert AIS in all DS1 or E1 outputs of
M12 demultiplexer Y when M13_DS2_OOFy = 1 (
Table 252
on page 213
).
M13_AUTO_FLB
M13_AUTO_FLB Bit.
If this bit Is 1, the device will automati-
cally loop the received DS3 input to the transmit DS3 output
when M13_DS3_FLB_DET = 1 (
Table 263 on page 216
), and
it will automatically select DS1/E1 output
x
from an M12
demultiplexer in place of the DS1/E1 output from input selec-
tor
x
when M13_DS1_FEAC_LB_DETx = 1 (
Table 263 on
page 216
).
M13_AUTO_LB
M13_AUTO_LB Bit.
When M13_AUTO_LB = 1, loopback of
DS1 channel x is activated if M13_DS1_LB_DETx = 1
(
Table 261 on page 215
).
1
2
M13_AUTO_AIS_OOF Bit.
If this bit is 1, the M13 will auto-
1
1
0
0
0
Name
Function
Reset
Default
0x0000
0
0x1005D 15:2
RSVD
Reserved.
M13_M23_CBP Bit.
If this bit Is 1, the M13 operates in the
M23 mode; otherwise, it is in the C-bit parity mode.
M13_BIPOLAR Bit.
The M13 performs B3ZS encoding and
decoding if this bit is high.
1
M13_M23_CBP
0
M13_BIPOLAR
0
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x1005E 15:8
RSVD
Reserved.
The register determines the offset value (0—255) for the trans-
mit NSMI sync pulse ahead of the M1 bit in a DS3 frame.
7:0
M13_NSMI_SP_
OFFSET[7:0]
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x1005F
15:8
7:0
RSVD
Reserved.
The register determines the offset value (0—255) for the
receive NSMI sync pulse ahead of the M1 bit in a DS3 frame.
M13_NSMI_SP_D_
OFFSET[7:0]
Table 271. M13_CONTROL2, Control 2 (R/W)
(continued)
Address
Bit
Name
Function
Reset
Default
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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