參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 173/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
10 VT/TU Mapper Registers
(continued)
173
Agere Systems Inc.
Table 218. VT_RTUOH_CTL[1—28], Receive TU Overhead Control Per Channel (RO)
Table 219. VT_RBIP2_CNT[1—28], Receive BIP-2 Error Count Per Channel (RO)
Table 220. VT_RREIV_CNT[1—28], Receive REI-V Error Count Per Channel (RO)
0x20328
—
0x20343
12:8
VT_RXSIG_CH_SEL[1—28][4:0]
Receive Output Channel Selection.
These bits
are programmed with the same value as the
cross connect for each individual channel. The
bits are
only used in byte-synchronous mode
and can be set to 0xXX for all other modes. If an
invalid value is programmed, UNEQ-V will be
transmitted in the specified channel. Invalid deci-
mal values are 0, 29, 30, and 31. See
Table 568
on page 446
.
J2 Trace Monitoring Mode Control.
See
Sec-
tion 19.11, J2 Byte Monitor and Termination
(J2MON), on page 444.
Receive Path Enhanced RDI-V Enable.
Logic 1
enables enhanced RDI-V.
Receive Demapping Mode Control.
See
Table 567 on page 443
.
0x00
7:5
VT_J2MON_MODE[1—28][2:0]
0x00
4
VT_RX_ERDI_EN[1—28]
0x0
3:0
VT_RX_MAPTYPE[1—28][3:0]
0x6
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x20344
—
0x2035F
15:8
7:0
VT_Z6_BYTE[1—28][7:0]
Received Z6/N2 Byte Value.
Accepted Z6/N2 value.
VT_OBITS[1—28][7:0]
Received O Bits Value.
Accepted overhead bits in
asynchronous and bit-synchronous modes.
VT_OBITS[7:4] are the O bits received in the byte follow-
ing J2, and VT_OBITS[3:0] are the O bits received in the
byte following Z6/N2.
Address
Bit
Name
Function
Reset
Default
0x0
0x000
0x20360
—
0x2037B
15:12
11:0
RSVD
Reserved.
VT_BIP2ERR_CNT[1—28][11:0]
BIP-2 Error Count.
BIP-2 error count updated on
a 0 to 1 transition of SMPR_PMRESET (
Table 75
on page 68
).
Address
Bit
Name
Function
Reset
Default
0x00
0x000
0x2037C
—
0x20397
15:11
10:0
RSVD
Reserved.
REI-V Error Count.
REI-V error count updated
on a 0 to 1 transition of SMPR_PMRESET.
VT_REI_CNT[1—28][10:0]
Table 217. VT_RCTL[1—28], Receive Control Per Channel (R/W)
(continued)
Address
Bit
Name
Function
Reset
Default
相關PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關代理商/技術參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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