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參數(shù)資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數(shù)： | 95/179頁 |
| 文件大?。?/td> | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 90 -
9.5.3
Endpoint FIFOs (Rx, Tx)
Each endpoint FIFO has the specific number of FIFO depth according to data transfer rate. In case of
maximum packet size for bulk transfer is 32 bytes that is supported in USBD. Each FIFO generates data ready
signals (means FIFO not full or FIFO not empty) to AMBA IF. It contains the control logic for transferring 4
bytes at a read/write strobe generated by AMBA to obtain better efficiency of AMBA bus.
9.5.4
External Signals
Pin Name
USBP
USBN
Type
I/O
I/O
Description
USB transceiver signal for P+
USB transceiver signal for N+
9.5.5
Registers
Address
0x8005.1000
0x8005.1004
0x8005.1008
0x8005.100C
0x8005.1010
0x8005.1018
0x8005.101C
0x8005.1020
0x8005.1024
0x8005.1028
0x8005.102C
0x8005.1030
0x8005.1034
0x8005.1038
Name
GCTRL
EPCTRL
INTMASK
INTSTAT
PWR
DEVID
DEVCLASS
INTCLASS
SETUP0
SETUP1
ENDP0RD
ENDP0WT
ENDP1RD
ENDP2WT
Width
4
21
10
20
4
32
32
32
32
32
32
32
32
32
Default
0x0
0x0
0x3ff
0x0
0x0
0x721005b4
0xffffff
0xffffff
-
-
-
-
-
-
Description
USB Global Configuration Register
Endpoint Control Register
Interrupt Mask Register
Interrupt Status Register
Power Control Register
Device ID Register
Device Class Register
Interface Class Register
SETUP Device Request Lower Address
SETUP Device Request Upper Address
ENDPOINT0 Read Address
ENDPOINT0 WRITE Address
ENDPOINT1 READ Address
ENDPOINT2 WRITE Address
Table 9-20 USB Slave interface Register Summary
9.5.5.1
GCTRL
0x8005.1000
0
DMADis
31 4
Reserved
3
TRANSel
2
WBack
1
Resume
Bits
3
Type
R/W
Function
USB Transceiver power-down mode selection. When this bit is high, SUSPEND signal of
internal USB transceiver is forced to go high immediately. This is for power-down scheme of
that transceiver when USB function is NOT used. It is recommended that this value keeps
zero while USB normal operation
HMS30C7210 does not supports Write-Back clear mode for Interrupt Status Register.
This bit must be set to ‘0’.
This Enables Remote Resume Capabilities. When This Bit Set, USB Drives remote resume
signaling. Should be cleared to stop resume
DMA Disable bit. HMS30C7210 does not support DMA, so value of this bit (logic 1) is not
changeable
2
R/W
1
R/W
0
R
9.5.5.2
EPCTRL
0x8005.1004
12
E2En
31 21
Reserved
20
CLR2
19
CLR1
18
CLR0
17 16
E2TXB
15
E2SND
14
E2NK
13
E2ST
11
10
9
8
7 4
3
2
1
0
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PDF描述 |
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