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參數(shù)資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數(shù)： | 119/179頁 |
| 文件大?。?/td> | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
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IRQ priority 12
IRQ priority 11
IRQ priority 10
IRQ priority F
IRQ priority E
IRQ priority D
IRQ priority C
IRQ priority B
IRQ priority A
IRQ priority 9
IRQ priority 8
IRQ priority 7
IRQ priority 6
IRQ priority 5
IRQ priority 4
IRQ priority 3
IRQ priority 2
IRQ priority 1
IRQ priority 0 or
FIQ source *
PSR5
PSR4
PSR3
PSR2
PSR1
PSR0
Note
The Priority Level is to be defined as follows.
IRQ Priority 0 or
FIQ source
> IRQ Priority 1 > IRQ Priority 2 > . . . > IRQ Priority 1D> IRQ Priority 1E
* Disable Interrupt Type Bit(
IER Bit31)
:
FIQ source /
Enable Interrupt Type Bit(
IER Bit31)
: IRQ priority 0
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PDF描述 |
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