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參數(shù)資料
| 型號(hào)： | DS34S132GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 3/194頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 電路數(shù)： | 1 |
| 電源電壓： | 1.8V, 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 676-BGA |
| 供應(yīng)商設(shè)備封裝： | 676-PBGA（27x27） |
| 包裝： | 管件 |
| 其它名稱： | 90-34S13+2N0 |
第1頁第2頁當(dāng)前第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁
DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
100 of 194
B. Field
Name
Addr (A:)
Bit [x:y] Type
Description
G23SRL. A:015Ch
Group 23 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[191:184]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [191:184] respectively.
G24SRL. A:0160h
Group 24 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[199:192]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [199:192] respectively.
G25SRL. A:0164h
Group 25 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[207:200]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [207:200] respectively.
G26SRL. A:0168h
Group 26 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[215:208]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [215:208] respectively.
G27SRL. A:016Ch
Group 27 Status Register Latch.
RSVD
[31:8]
Reserved.
CWCDSL
[223:216]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [223:216] respectively.
G28SRL. A:0170h
Group 28 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[231:224]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [231:224] respectively.
G29SRL. A:0174h
Group 29 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[239:232]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [239:232] respectively.
G30SRL. A:0178h
Group 30 Status Register Latch.
RSVD
[31:8]
Reserved.
CWCDSL
[247:240]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [247:240] respectively.
G31SRL. A:017Ch
Group 31 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
CWCDSL
[255:248]
[7:0] rls-cor-i3
Control Word Change Detect Status Latch = “1” indicates change detected in a
Control Word for a Bundle. Bits [7:0] indicate Bundles [255:248] respectively.
10.3.2.5 Bundle Status Register Interrupt Enables (B.)
Table 10-10. Bundle Status Register Interrupt Enables (B.)
B. Field
Name
Addr (A:)
Bit [x:y] Type
Description
G0SRIE. A:0180h
Group 0 Status Register Interrupt Enable. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
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| DS34T101_08 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_09 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
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