參數(shù)資料
型號(hào)： OR3TP12
英文描述： Field-Programmable System Chip (FPSC) Embedded Master/Target PCI Interface
中文描述： 現(xiàn)場(chǎng)可編程系統(tǒng)芯片（促進(jìn)文化基金）嵌入式主/目標(biāo)PCI接口
文件頁(yè)數(shù)： 33/128頁(yè)
文件大小： 2450K
代理商： OR3TP12
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Lucent Technologies Inc.
Lucent Technologies Inc.
33
Data Sheet
March 2000
ORCA OR3TP12 FPSC
Embedded Master/Target PCI Interface
PCI Bus Core Detailed Description
(continued)
Embedded Core/FPGA FIFO Interface Operation Summary
The following sections describe the Master and Target FIFO interface operation between the PCI bus core and the
FPGA application. Table 9 is an index to the state tables and timing figures provided for each of the operational
modes (dual-port, quad-port) of the FIFO interface.
Table 9. Index to State Sequence Tables
* The FPGA interface does not participate in Target configuration operations.
Dual-Port Mode
Quad-Port Mode
Master/
Target
PCI
Access
Type
Address
Type
Single/Burst and
Delayed/
Nondelayed
PCI
Bus
Timing
Figure
5
8
11
14
15
—
16
State
Table
FPGA
Bus
Timing
Figure
3
6
9
12
*
18
State
Table
FPGA
Bus
Timing
Figure
4
7
10
13
*
19
Master
Write
Config,
Memory, I/O
Config,
Memory, I/O
Config
I/O
Single
Burst
Single
Burst
Single
13
14
Read
15
16
17
21
Target
Write
20
Single, Delayed
Single,
Nondelayed
Single
Burst
Single
Delayed
Nondelayed
Single
Single, Delayed
Burst
Burst, Delayed
Memory
17
20
23
24
25
29
26
33
30
21
*
27
22
*
28
Read
Config
I/O
22
23
Memory
31
32
相關(guān)PDF資料
PDF描述
OR62 OR62 is a 6-input OR gate with 2x drive strength
OR73 7-input OR gate with 3x drive strength.
OR8GU41 DIFFUSED TYPE (HIGH SPEED RECTIFIER APPLICATIONS)
ORCAORT4622 Field-Programmable System Chip (FPSC) Four-Channel x 622 Mbits/s Backplane Transceiver
ORCAORT82G5 1.0?.25/2.0?.5/3.125 Gbits/s Backplane Interface FPSC
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參數(shù)描述
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OR3TP12-6BA352 制造商:未知廠家 制造商全稱:未知廠家 功能描述:User Programmable Special Function ASIC
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