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參數(shù)資料
| 型號： | TMP90C051 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed CMOS 8-bit Microcontroller,Integrating DMA, DRAM Controller,Serial Interface, Timer/Event Counter(高速 CMOS 8位微控制器（芯片集成了DMA,DRAM控制器，串行接口，定時器/事件計數(shù)器）) |
| 中文描述： | 高速CMOS 8位微控制器，集成的DMA，DRAM控制器，串行接口，定時器/事件計數(shù)器（高速的CMOS 8位微控制器（DMA的芯片集成了，內(nèi)存控制器，串行接口，定時器/事件計數(shù)器）） |
| 文件頁數(shù)： | 76/158頁 |
| 文件大?。?/td> | 4573K |
| 代理商： | TMP90C051 |
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TOSHIBA CORPORATION
TMP90C051
Setting example:
Setting the registers as shown below
when driving channel 0 (M0) with timer
0 at 4-phase, 1-2 excitations.
3.7.4 Timer Trigger Signals
The trigger signals used with SMC are not the same as the
timer flip-flop (TFF1, 3) inversion trigger signals, but differ as
shown in Table 3.7 (1) depending on the timer operation mode.
Note:
It is necessary to TFFCR1 (FF1IE) to “1” and enable TFF1 inversion when SMC is shifted.
Table 3.7 (1) Using 8-bit timers 0 and 1 (same for timers 2 and 3)
TFF1 Inversion
SMC shift
8-bit timer mode
Selected with TFFCR0 (FF1IS) when the up counter matches TREG0 or
TREG1.
←
16-bit timer mode
Selected when the up counter matches both TREG0 and TREG1 (up counter
value = TREG*28 + TREG0).
←
PPG output mode
Selected when the up counter matches TREG0 and TREG1, respectively.
Selected when the up counter matches TREG1 (PPG cycle).
PWM output mode
Selected when the up counter matches TREG0.
The SMC shift trigger signal is not generated.
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PDF描述 |
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