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參數(shù)資料
| 型號： | TMP90C051 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed CMOS 8-bit Microcontroller,Integrating DMA, DRAM Controller,Serial Interface, Timer/Event Counter(高速 CMOS 8位微控制器（芯片集成了DMA,DRAM控制器，串行接口，定時器/事件計數(shù)器）) |
| 中文描述： | 高速CMOS 8位微控制器，集成的DMA，DRAM控制器，串行接口，定時器/事件計數(shù)器（高速的CMOS 8位微控制器（DMA的芯片集成了，內(nèi)存控制器，串行接口，定時器/事件計數(shù)器）） |
| 文件頁數(shù)： | 49/158頁 |
| 文件大小： | 4573K |
| 代理商： | TMP90C051 |
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TOSHIBA CORPORATION
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TMP90C051
3.5.1 RUN Mode
Figure 3.5 (2) shows the timing used to release halts using
interrupts in the RUN mode.
In the RUN mode, the system clock in the MCU does not
stop after the HALT instruction is executed; the CPU merely
stops executing instructions. That is, the CPU repeats dummy
cycles until the halt status is released. In the halt status, interrupt
requests are sampled at CLK signal falls.
Figure 3.5 (2). Halt Release Timing Using Interrupts in the RUN Mode
*: Halt status can be released with external interrupts (INT1 - INT7) only in the RUN mode.
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PDF描述 |
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