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參數(shù)資料
| 型號： | TMP90C051 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed CMOS 8-bit Microcontroller,Integrating DMA, DRAM Controller,Serial Interface, Timer/Event Counter(高速 CMOS 8位微控制器（芯片集成了DMA,DRAM控制器，串行接口，定時器/事件計數(shù)器）) |
| 中文描述： | 高速CMOS 8位微控制器，集成的DMA，DRAM控制器，串行接口，定時器/事件計數(shù)器（高速的CMOS 8位微控制器（DMA的芯片集成了，內(nèi)存控制器，串行接口，定時器/事件計數(shù)器）） |
| 文件頁數(shù)： | 33/158頁 |
| 文件大小： | 4573K |
| 代理商： | TMP90C051 |
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TOSHIBA CORPORATION
33/184
TMP90C051
3.4 MMU
3.4.1 Address Area Extension
The TMP90C051F can access the extended address area
(10000H -7FFFFFH) using the following three methods.
Address extension method
(1)
Extended data area access using CPU bank registers
BX and BY.
(2)
Extended data area access during HDMA (high-speed
DMA) transfers (source addresses bank register:
DMAS0 and DMAS1; destination address bank register:
DMADB0 and DMADB1).
(3)
Extended program area and extended data area
access by the MMU.
As shown in figure 3.4 (1), the TMP90C051F can also use
CLLAR (common local logical address register) of the MMU to
specify common 0, local 0, common 1 and local 1 areas in the
logical area at address 0000H - FFFFH.
Table 3.4 (1) shows in what areas of the logical address
area the above three methods can be used.
Figure 3.4 (1). Logical Area Specification
Table 3.4 (1) Address Extensions for Each Area of the Logical Area
Logical area
BX, BY
MMU
DMASB0/1, DMADB0/1
Common 0
O
X
O
Local 0
O
O
O
Local 1
O
O
O
Common 1
O
X
O
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PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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