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參數(shù)資料
| 型號： | TMP90C051 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed CMOS 8-bit Microcontroller,Integrating DMA, DRAM Controller,Serial Interface, Timer/Event Counter(高速 CMOS 8位微控制器（芯片集成了DMA,DRAM控制器，串行接口，定時器/事件計數(shù)器）) |
| 中文描述： | 高速CMOS 8位微控制器，集成的DMA，DRAM控制器，串行接口，定時器/事件計數(shù)器（高速的CMOS 8位微控制器（DMA的芯片集成了，內(nèi)存控制器，串行接口，定時器/事件計數(shù)器）） |
| 文件頁數(shù)： | 114/158頁 |
| 文件大?。?/td> | 4573K |
| 代理商： | TMP90C051 |
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114/184
TOSHIBA CORPORATION
TMP90C051
Protocol
Set the master and slave controller to the 9-bit
UART mode.
Set the SCMOD0 <WU0> bit of a slave controller to
“1” to enable receiving.
The master controller transmits 1 frame, including
the select code (8 bits) of the slave controller. The
uppermost bit SCMOD0 <TB08> is set to “1” at this
time.
The slave controller receives the frames and, if its
own select code matches the received data, clears
the <WU0> bit to “0”.
The master controller transmits data to the specified
slave controller (with <WU0> cleared to “0”). At this
time, the uppermost bit <TB08> is cleared to “0”.
Even with <WU0> set to “1”, the slave controller will
neither generate interrupt INTRX0 nor read receive
data as long as <RB08>is cleared to “0”.
When both <WU0> and <RB08> are set to “1”, the
slave controller will always generate interrupt
INTRX0 and read the receive data.
Then, when <WU0> is cleared to “0”, this is
reported to the master controller to inform it that
receiving has ended.
Setting example: Serially linking two slave control-
lers using internal clock 1 as
the transfer clock at using ch0.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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