參數(shù)資料
型號： TMS320DM355_07
廠商： Texas Instruments, Inc.
英文描述： Digital Media System-on-Chip (DMSoC)
中文描述： 數(shù)字媒體系統(tǒng)芯片（DMSoC）
文件頁數(shù)： 68/158頁
文件大小： 1319K
代理商： TMS320DM355_07
www.ti.com
P
TMS320DM355
Digital Media System-on-Chip (DMSoC)
SPRS463B–SEPTEMBER 2007–REVISED OCTOBER 2007
3.5.2.2
Supported Clocking Configurations for DM355-216 (36 MHz reference)
3.5.2.2.1
DM355-216 PLL1 (36 MHz reference)
All supported clocking configurations for DM355-216 PLL1 with 36 MHz reference clock are shown in
Table 3-4
Table 3-4. PLL1 Supported Clocking Configurations DM355-216 (36 MHz reference)
PREDI
V
PLLM
POSTDIV
PLL1
VCO
ARM /
MPEG and
J PEG
Co-Processor
PLLDIV
1
(/2
fixed)
2
2
2
2
2
2
2
2
2
2
Peripherals
VENC
VPSS
(/8
(m
(/2 or /1
programma
ble)
(MHz)
SYSCL
K1
(MHz)
PLLDIV SYSCLK
2
(/4
fixed)
4
4
4
4
4
4
4
4
4
4
PLLDIV3
(/n
programma
ble)
10
16
15
14
13
12
11
10
9
8
SYSCLK
3
(MHz)
PLLDIV4
(/4 or /2
programmable
)
4
4
4
4
4
4
4
2
2
2
SYSCLK
4
(MHz)
fixed)
programmable
)
2
(MHz)
bypass
8
8
8
8
8
8
8
8
8
bypass
96
180
168
156
144
132
120
108
96
bypass
1
2
2
2
2
2
2
2
2
bypass
432
405
378
351
324
297
270
243
216
18
216
202.5
189
175.5
162
148.5
135
121.5
108
9
3.6
27
27
27
27
27
27
27
27
27
9
108
101.25
94.5
87.75
81
74.25
67.5
60.75
54
108
101.25
94.5
87.75
81
74.25
135
121.5
108
3.5.2.2.2
DM355-216 PLL2 (36 MHz reference)
All supported clocking configurations for DM355-216 PLL2 with 36 MHz reference clock are shown in
Table 3-5
Table 3-5. PLL2 Supported Clocking Configurations for DM355-216 (36 MHz reference)
PREDIV
PLLM
(m
POSTDIV
(/1 fixed)
PLL2 VCO
(MHz)
DDR PHY
DDR Clock
DDR_CLK
(MHz)
18
171
162
153
144
133
100
80
(/n programmable)
PLLDIV1
(/1 fixed)
1
1
1
1
1
1
1
1
SYSCLK1
(MHz)
36
342
324
306
288
266
200
160
programmable)
bypass
114
108
102
96
133
150
120
bypass
12
12
12
12
18
27
27
bypass
1
1
1
1
1
1
1
bypass
342
324
306
288
266
200
160
Detailed Device Description
68
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