參數(shù)資料
型號： TMS320DM355_07
廠商： Texas Instruments, Inc.
英文描述： Digital Media System-on-Chip (DMSoC)
中文描述： 數(shù)字媒體系統(tǒng)芯片（DMSoC）
文件頁數(shù)： 123/158頁
文件大?。?/td> 1319K
代理商： TMS320DM355_07
www.ti.com
P
VCLKIN
(A)
(Positive Edge Clocking)
9
VCLKIN
(A)
(Negative Edge Clocking)
10
VCTL
(B)
A. VCLKIN = PCLK or EXTCLK
B. VCTL = HSYNC, VSYNC, and FIELD
VCLKIN
(A)
(Positive Edge Clocking)
13
VCLKIN
(A)
(Negative Edge Clocking)
11
VCTL
(B)
A. VCLKIN = PCLK or EXTCLK
B. VCTL = HSYNC, VSYNC, FIELD, and LCD_OE
C. VDATA = COUT[7:0], YOUT[7:0], R[7:3], G[7:2], and B[7:3]
VDATA
(C)
14
12
TMS320DM355
Digital Media System-on-Chip (DMSoC)
SPRS463B–SEPTEMBER 2007–REVISED OCTOBER 2007
Figure 5-28. VPBE Input Timing With Respect to PCLK and EXTCLK
Table 5-23. Switching Characteristics Over Recommended Operating Conditions for VPBE Control and
Data Output With Respect to PCLK and EXTCLK
(1)(2)(3)
(see
Figure 5-29
)
DM355
MIN
NO.
PARAMETER
UNIT
MAX
13.3
11
12
13
14
t
d(VCLKIN-VCTLV)
t
d(VCLKIN-VCTLIV)
t
d(VCLKIN-VDATAV)
t
d(VCLKIN-VDATAIV)
Delay time, VCLKIN edge to VCTL valid
Delay time, VCLKIN edge to VCTL invalid
Delay time, VCLKIN edge to VDATA valid
Delay time, VCLKIN edge to VDATA invalid
ns
ns
ns
ns
2
13.3
2
(1)
The VPBE may be configured to operate in either positive or negative edge clocking mode. When in positive edge clocking mode, the
rising edge of VCLKIN is referenced. When in negative edge clocking mode, the falling edge of VCLKIN is referenced.
VCLKIN = PCLK or EXTCLK
VCTL = HSYNC, VSYNC, FIELD, and LCD_OE
(2)
(3)
Figure 5-29. VPBE Control and Data Output With Respect to PCLK and EXTCLK
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DM355 Peripheral Information and Electrical Specifications
123
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