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參數(shù)資料
| 型號(hào)： | TMS320DM355_07 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip (DMSoC) |
| 中文描述： | 數(shù)字媒體系統(tǒng)芯片（DMSoC） |
| 文件頁數(shù)： | 120/158頁 |
| 文件大?。?/td> | 1319K |
| 代理商： | TMS320DM355_07 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁當(dāng)前第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
www.ti.com
P
PCLK
(Positive Edge Clocking)
18
20
HD
VD
PCLK
(Negative Edge Clocking)
5.9.2
Video Processing Back-End (VPBE)
TMS320DM355
Digital Media System-on-Chip (DMSoC)
SPRS463B–SEPTEMBER 2007–REVISED OCTOBER 2007
Table 5-20. Switching Characteristics Over Recommended Operating Conditions for VPFE (CCD) Master
Mode (see
Figure 5-26
)
DM355
MIN
3
3
NO.
PARAMETER
UNIT
MAX
18
20
t
d(PCLKL-HDIV)
t
d(PCLKL-VDIV)
Delay time, PCLK edge to HD invalid
Delay time, PCLK edge to VD invalid
11
11
ns
ns
Figure 5-26. VPFE (CCD) Master Mode Control Output Data Timing
The Video Processing Back-End of VPBE module is comprised of the On Screen Display (OSD) module
and the Video Encoder / Digital LCD Controller (VENC/DLCD).
5.9.2.1
On-Screen Display (OSD)
The primary function of the OSD module is to gather and blend video data and display/bitmap data and
then pass it to the Video Encoder (VENC) in YCbCr format. The video and display data is read from
external DDR2/mDDR memory. The OSD is programmed via control and parameter registers. The
following are the primary features that are supported by the OSD.
Support for two video windows and two OSD bitmapped windows that can be displayed simultaneously
(VIDWIN0/VIDWIN1 and OSDWIN0/OSDWIN1).
Video windows supports YCbCr data in 422 format from external memory, with the ability to
interchange the order of the CbCr component in the 32-bit word
OSD bitmap windows support 1/2/4/8 bit width index data of color palette
In addition one OSD bitmap window at a time can be configured to one of the following:
–
YUV422 (same as video data)
–
RGB format data in 16-bit mode (R=5bit, G=6bit, B=5bit)
–
24-bit mode (each R/G/B=8bit) with pixel level blending with video windows
Programmable color palette with the ability to select between a RAM/ROM table with support for 256
colors.
Support for 2 ROM tables, one of which can be selected at a given time
Separate enable/disable control for each window
Programmable width, height, and base starting coordinates for each window
External memory address and offset registers for each window
Support for x2 and x4 zoom in both the horizontal and vertical direction
Pixel-level blending/transparency/blinking attributes can be defined for OSDWIN0 when OSDWIN1 is
configured as an attribute window for OSDWIN0.
Support for blinking intervals to the attribute window
Ability to select either field/frame mode for the windows (interlaced/progressive)
An eight step blending process between the bitmap and video windows
Transparency support for the bitmap and video data (when a bitmap pixel is zero, there will be no
DM355 Peripheral Information and Electrical Specifications
120
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