參數(shù)資料
型號： TMS320DM355_07
廠商： Texas Instruments, Inc.
英文描述： Digital Media System-on-Chip (DMSoC)
中文描述： 數(shù)字媒體系統(tǒng)芯片（DMSoC）
文件頁數(shù)： 133/158頁
文件大?。?/td> 1319K
代理商： TMS320DM355_07
www.ti.com
P
SPI_CLK
(Clock Polarity = 0)
SPI_CLK
(Clock Polarity = 1)
SPI_DI
(Input)
SPI_DO
(Output)
13
MSB IN
DATA
LSB IN
LSB OUT
MSB OUT
DATA
17
15
14
16
SPI_EN
19
18
TMS320DM355
Digital Media System-on-Chip (DMSoC)
SPRS463B–SEPTEMBER 2007–REVISED OCTOBER 2007
SPI Master Mode Timings (Clock Phase = 1)
Table 5-31. Timing Requirements for SPI Master Mode [Clock Phase = 1] (see
Figure 5-38
)
DM355
MIN
NO.
UNIT
MAX
Setup time, SPI_DI (input) valid before SPI_CLK (output)
rising edge
Setup time, SPI_DI (in put) valid before SPI_CLK (output)
falling edge
Hold time, SPI_DI (input) valid after SPI_CLK (output) rising
edge
Hold time, SPI_DI (input) valid after SPI_CLK (output) falling
edge
13
t
su(DIV-CLKL)
Clock Polarity = 0
.5P + 3
ns
14
t
su(DIV-CLKH)
Clock Polarity = 1
.5P + 3
ns
15
t
h(CLKL-DIV)
Clock Polarity = 0
.5P + 3
ns
16
t
h(CLKH-DIV)
Clock Polarity = 1
.5P + 3
ns
Table 5-32. Switching Characteristics Over Recommended Operating Conditions for SPI Master Mode
[Clock Phase = 1] (see
Figure 5-38
)
DM355
MIN
NO.
PARAMETER
UNIT
MAX
Delay time, SPI_CLK (output) falling edge to SPI_DO
(output) transition
Delay time, SPI_CLK (output) rising edge to SPI_DO
(output) transition
Delay time, SPI_EN[1:0] (output) falling edge to first SPI_CLK (output) rising or falling
edge
t
d(CLKL/H-DOHz)
Delay time, SPI_CLK (output) falling or rising edge to SPI_DO (output) high impedance
17
t
d(CLKL-DOV)
Clock Polarity = 0
-4
5
ns
18
t
d(CLKH-DOV)
Clock Polarity = 1
-4
5
ns
2P+.5C
19
t
d(ENL-CLKH/L)
(1)
ns
20
P
(2)
(2)
ns
(1)
The delay time can be adjusted using the SPI module register C2TDELAY. See the TMS320DM355 DMSoC Serial Peripheral Interface
(SPI) User's Guide (SPRUED4).
The delay time can be adjusted using the SPI module register T2CDELAY. See the TMS320DM355 DMSoC Serial Peripheral Interface
(SPI) User's Guide (SPRUED4).
(2)
Figure 5-38. SPI Master Mode External Timing (Clock Phase = 1)
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DM355 Peripheral Information and Electrical Specifications
133
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PDF描述
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