參數(shù)資料
型號： TMS320DM355_07
廠商： Texas Instruments, Inc.
英文描述： Digital Media System-on-Chip (DMSoC)
中文描述： 數(shù)字媒體系統(tǒng)芯片（DMSoC）
文件頁數(shù)： 21/158頁
文件大?。?/td> 1319K
代理商： TMS320DM355_07
www.ti.com
P
TMS320DM355
Digital Media System-on-Chip (DMSoC)
SPRS463B–SEPTEMBER 2007–REVISED OCTOBER 2007
Table 2-10. DDR Terminal Functions (continued)
TERMINAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
NAME
DDR_A10
DDR_A09
DDR_A08
DDR_A07
DDR_A06
DDR_A05
DDR_A04
DDR_A03
DDR_A02
DDR_A01
DDR_A00
DDR_DQ15
DDR_DQ14
DDR_DQ13
DDR_DQ12
DDR_DQ11
DDR_DQ10
DDR_DQ09
DDR_DQ08
DDR_DQ07
DDR_DQ06
DDR_DQ05
DDR_DQ04
DDR_DQ03
DDR_DQ02
DDR_DQ01
DDR_DQ00
DDR_
DQGATE0
DDR_
DQGATE1
NO.
V6
W6
W5
V5
U5
W4
V4
W3
W2
V3
V2
W17
V16
W16
U16
W15
W14
V14
U13
W13
V13
W12
U12
T11
U11
W11
V11
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
I/O/Z
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
V
DD_DDR
DDR Address Bus bit 10
DDR Address Bus bit 09
DDR Address Bus bit 08
DDR Address Bus bit 07
DDR Address Bus bit 06
DDR Address Bus bit 05
DDR Address Bus bit 04
DDR Address Bus bit 03
DDR Address Bus bit 02
DDR Address Bus bit 01
DDR Address Bus bit 00
DDR Data Bus bit 15
DDR Data Bus bit 14
DDR Data Bus bit 13
DDR Data Bus bit 12
DDR Data Bus bit 11
DDR Data Bus bit 10
DDR Data Bus bit 09
DDR Data Bus bit 08
DDR Data Bus bit 07
DDR Data Bus bit 06
DDR Data Bus bit 05
DDR Data Bus bit 04
DDR Data Bus bit 03
DDR Data Bus bit 02
DDR Data Bus bit 01
DDR Data Bus bit 00
DDR: Loopback signal for external DQS gating. Route to DDR and back to
DDR_DQGATE1 with same constraints as used for DDR clock and data.
DDR: Loopback signal for external DQS gating. Route to DDR and back to
DDR_DQGATE0 with same constraints as used for DDR clock and data.
DDR: Voltage input for the SSTL_18 I/O buffers. Note even in the case of mDDR
an external resistor divider connected to this pin is necessary.
DDR: Ground for the DDR DLL
W18
I/O/Z
V
DD_DDR
V17
I/O/Z
V
DD_DDR
DDR_VREF
U10
I/O/Z
V
DD_DDR
V
SSA_DLL
V
DDA33_DDR
DLL
R11
I/O/Z
V
DD_DDR
R10
I/O/Z
V
DD_DDR
DDR: Power (3.3 V) for the DDR DLL
DDR: Reference output for drive strength calibration of N and P channel outputs.
Tie to ground via 50 ohm resistor @ 0.5% tolerance.
DDR_ZN
T9
I/O/Z
V
DD_DDR
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Device Overview
21
相關(guān)PDF資料
PDF描述
TMS320DM6446_07 Digital Media System-on-Chip
TMS320F2801X Digital Signal Processors
TMS320F2809_07 Digital Signal Processors
TMS320F28335_1 Variable Capacitance Diode for TV Tuner VHF Tuning; Ratings VR (V): 32; Characteristics n: 12.0 min; Characteristics rs (ohm) max: 0.85; Characteristics C (pF) max: C2 = 32.2 to 37.5 C25 = 2.57 to 3.0; Characteristics CVR/CVR: 2/25; Cl: 2.777; Package: UFP
TMS4024 9 X 64 DIGITAL STORAGE BUFFER (FIFO)
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參數(shù)描述
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