參數(shù)資料
型號(hào): DS2196LN
廠商: DALLAS SEMICONDUCTOR
元件分類: Digital Transmission Controller
英文描述: DATACOM, FRAMER, PQFP100
封裝: LQFP-100
文件頁(yè)數(shù): 74/160頁(yè)
文件大?。?/td> 559K
代理商: DS2196LN
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DS2196
20 of 160
LINE INTERFACE PINS
Signal Name:
MCLK
Signal Description:
Master Clock Input
Signal Type:
Input
A 1.544 MHz (±50 ppm) clock source with TTL levels is applied at this pin. This clock is used internally
for both clock/data recovery and for jitter attenuation. This clock is also used to source AIS within the
LIU.
Signal Name:
RTIP & RRING
Signal Description:
Receive Tip and Ring
Signal Type:
Input
Analog inputs for clock recovery circuitry. These pins connect via a 1:1 transformer to the T1 line. See
Section 19 for details.
Signal Name:
TTIP & TRING
Signal Description:
Transmit Tip and Ring
Signal Type:
Output
Analog line driver outputs. These pins connect via a 1:2 step–up transformer to the T1 line. See Section
19 for details.
Signal Name:
LFSYNC
Signal Description:
LIU Frame Sync
Signal Type:
Output
This digital output will provide either a frame synchronization pulse or the negative half of a bipolar data
stream. The signal is based on what is provided at the TNEGLI input.
Signal Name:
LNRZ
Signal Description:
LIU NRZ Data
Signal Type:
Output
This digital output will provide either a NRZ data stream or the positive half of a bipolar data stream.
The signal is based on what is provided at the TPOSLI input.
Signal Name:
LCLK
Signal Description:
LIU Clock
Signal Type:
Output
This digital output provides the 1.544 MHz transmit LIU clock. The signal is based on what is provided
at the TCLKLI input.
Signal Name:
TNEGLI
Signal Description:
Transmit Negative Data for the LIU
Signal Type:
Input
This digital input is used to pass either the negative half of a bipolar data stream or a frame
synchronization pulse via the jitter attenuator block to the transmit line driver block and the LFSYNC
output pin. Data input to this pin is sampled on the falling edge of TCLKLI. TNEGLI can be internally
connected to TNEGOA/TFSYNCA via the CCR4A.2 control bit.
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PDF描述
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DS21FF44N DATACOM, FRAMER, PBGA300
DS21FT40N DATACOM, FRAMER, PBGA300
DS21FT40 DATACOM, FRAMER, PBGA300
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