參數(shù)資料
型號： DS2196LN
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PQFP100
封裝： LQFP-100
文件頁數(shù)： 151/160頁
文件大小： 559K
代理商： DS2196LN
DS2196
90 of 160
Formatter A/B Select mux
mux
cl
o
c
k
data
fs
y
n
c
tc
hbl
k
cl
o
c
k
normal
transmit
data
Transmit Formatter A
cl
o
c
k
data
fs
y
n
c
tc
hbl
k
cl
o
c
k
data
cl
o
c
k
cl
o
c
k
tc
hbl
k
fs
y
n
c
Formatter / FLB B Select Mux
Transmit
Load
Signal
Generation
No
te
1
No
te
2
TRANSMIT SIDE
RECEIVE
SIDE
Frame Sync
Align Toggle
(BIC.3)
FLB B
BERT Select
(decoded from
CCR1B.2 & CCR1B.3)
Framed /
Unframed
Select
(BIC.2)
Use
TCHBLK
Select
(BIC.1)
Formatter
A/B
Select
(BIC.0)
Formatter
A
Formatter
B
Framer A
cl
o
c
k
data
rc
h
b
lk
fs
y
n
c
Framer B
cl
o
c
k
data
rc
h
b
lk
fs
y
n
c
Framer A/B Select mux
Framed /
Unframed
Select
(BIC.6)
Use
RCHBLK
Select
(BIC.5)
Framer
A/B
Select
(BIC.4)
No
te
1
No
te
2
bert_mux
BERT
cl
o
c
k
data
cl
o
c
k
data
tra
n
s
m
it
lo
a
d
cl
o
c
k
rc
h
b
lk
fs
y
n
c
data
Note 1: Always includes a clock pulse for the F-bit position
Note 2: F-bit clock is blocked in the framed mode
FLB B Mux
tpos/tnrz
tclk
tneg/
tfsync
thru
mode
BERT
mode
AIS
with
Sync
AIS
w/o
Sync
tpos/tnrz
tclk
tneg/
tfsync
enable
(CCR4A.5)
mux
normal
transmit
data
Transmit Formatter B
enable
(CCR4B.5)
CCR1B.2 /
CCR1B.3
Figure 15-1: BERT Mux Diagram
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PDF描述
DS21FF44 DATACOM, FRAMER, PBGA300
DS21FF44N DATACOM, FRAMER, PBGA300
DS21FT40N DATACOM, FRAMER, PBGA300
DS21FT40 DATACOM, FRAMER, PBGA300
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