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參數(shù)資料
| 型號： | ADUC7126BSTZ126-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 99/108頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 16/32B 126KB FLASH 80LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 41.78MHz |
| 連通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 126KB（63K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x12b，D/A 4x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 帶卷 (TR) |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁當(dāng)前第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁
ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 90 of 108
Bit
Value
Name
Description
[7:6]
11
IRQ2SRC[1:0]
External IRQ2 triggers on falling edge.
10
External IRQ2 triggers on rising edge.
01
External IRQ2 triggers on low level.
00
External IRQ2 triggers on high level.
[5:4]
11
PLA0SRC[1:0]
PLA IRQ0 triggers on falling edge.
10
PLA IRQ0 triggers on rising edge.
01
PLA IRQ0 triggers on low level.
00
PLA IRQ0 triggers on high level.
[3:2]
11
IRQ1SRC[1:0]
External IRQ1 triggers on falling edge.
10
External IRQ1 triggers on rising edge.
01
External IRQ1 triggers on low level.
00
External IRQ1 triggers on high level.
[1:0]
11
IRQ0SRC[1:0]
External IRQ0 triggers on falling edge.
10
External IRQ0 triggers on rising edge.
01
External IRQ0 triggers on low level.
00
External IRQ0 triggers on high level.
IRQCLRE Register
Name:
IRQCLRE
Address:
0xFFFF0038
Default Value:
0x00000000
Access:
Write only
Table 139. IRQCLRE MMR Bit Descriptions
Bit
Name
Description
[31:25]
Reserved. These bits are reserved and should not be written to.
24
PLA1CLRI
A 1 must be written to this bit in the PLA IRQ1 interrupt service routine to clear an edge-
triggered PLA IRQ1 interrupt.
23
IRQ3CLRI
A 1 must be written to this bit in the external IRQ3 interrupt service routine to clear an edge-
triggered IRQ3 interrupt.
22
IRQ2CLRI
A 1 must be written to this bit in the external IRQ2 interrupt service routine to clear an edge-
triggered IRQ2 interrupt.
21
PLA0CLRI
A 1 must be written to this bit in the PLA IRQ0 interrupt service routine to clear an edge-
triggered PLA IRQ0 interrupt.
20
IRQ1CLRI
A 1 must be written to this bit in the external IRQ1 interrupt service routine to clear an edge-
triggered IRQ1 interrupt.
[19:18]
Reserved. These bits are reserved and should not be written to.
17
IRQ0CLRI
A 1 must be written to this bit in the external IRQ0 interrupt service routine to clear an edge
triggered IRQ0 interrupt.
[16:0]
Reserved. These bits are reserved and should not be written to.
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PDF描述 |
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