Enable CONV
參數(shù)資料
型號(hào)： ADUC7126BSTZ126-RL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 42/108頁(yè)
文件大?。?/td> 0K
描述： IC MCU 16/32B 126KB FLASH 80LQFP
標(biāo)準(zhǔn)包裝： 1,000
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 41.78MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 40
程序存儲(chǔ)器容量： 126KB（63K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x12b，D/A 4x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 80-LQFP
包裝： 帶卷 (TR)
Data Sheet
ADuC7124/ADuC7126
Rev. C | Page 39 of 108
Bit
Value
Description
[2:0]
Conversion type.
000
Enable CONVSTART pin as a conversion input.
001
Enable Timer1 as a conversion input.
010
Enable Timer0 as a conversion input.
011
Single software conversion. Sets to 000 after
conversion (note that Bit 7 of ADCCON MMR
should be cleared after starting a single
software conversion to avoid further
conversions triggered by the CONVSTART pin).
100
Continuous software conversion.
101
PLA conversion.
Other
Reserved.
ADCCP Register
Name:
ADCCP
Address:
0xFFFF0504
Default Value:
0x00
Access:
Read/write
ADCCP is an ADC positive channel selection register. This
MMR is described in Table 31.
Table 31. ADCCP1 MMR Bit Designation
Bit
Value
Description
[7:5]
Reserved.
[4:0]
Positive channel selection bits.
00000
ADC0.
00001
ADC1.
00010
ADC2.
00011
ADC3.
00100
ADC4.
00101
ADC5.
00110
ADC6.
00111
ADC7.
01000
ADC8.
01001
ADC9.
01010
ADC10.
01011
ADC11.
01100
DAC0/ADC12.
01101
DAC1/ADC13.
01110
DAC2/ADC14.
01111
DAC3/ADC15.
10000
Temperature sensor.
10001
AGND (self-diagnostic feature).
10010
Internal reference (self-diagnostic feature).
10011
AVDD/2.
Others
Reserved.
1 ADC and DAC channel availability depends on part model. See the Ordering
Guide for details.
ADCCN Register
Name:
ADCCN
Address:
0xFFFF0508
Default Value:
0x01
Access:
Read/write
ADCCN is an ADC negative channel selection register. This
MMR is described in Table 32.
Table 32. ADCCN MMR Bit Designation
Bit
Value
Description
[7:5]
Reserved.
[4:0]
Negative channel selection bits.
00000
ADC0.
00001
ADC1.
00010
ADC2.
00011
ADC3.
00100
ADC4.
00101
ADC5.
00110
ADC6.
00111
ADC7.
01000
ADC8.
01001
ADC9.
01010
ADC10.
01011
ADC11.
01100
DAC0/ADC12.
01101
DAC1/ADC13.
01110
DAC2/ADC14.
01111
DAC3/ADC15.
10000
Reserved.
10001
AGND.
10010
Reserved.
10011
Reserved.
Others
Reserved.
ADCSTA Register
Name:
ADCSTA
Address:
0xFFFF050C
Default Value:
0x00
Access:
Read only
ADCSTA is an ADC status register that indicates when an ADC
conversion result is ready. The ADCSTA register contains only
one bit, ADCReady (Bit 0), representing the status of the ADC.
This bit is set at the end of an ADC conversion, generating an
ADC interrupt. It is cleared automatically by reading the
ADCDAT MMR. When the ADC is performing a conversion,
the status of the ADC can be read externally via the ADCBUSY
pin. This pin is high during a conversion. When the conversion
is finished, ADCBUSY goes back low. This information is available
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