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參數(shù)資料
| 型號： | ADUC7126BSTZ126-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 50/108頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 16/32B 126KB FLASH 80LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 41.78MHz |
| 連通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 126KB（63K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x12b，D/A 4x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 帶卷 (TR) |
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ADuC7124/ADuC7126
Data Sheet
Rev. C | Page 46 of 108
Table 45. FEE1STA Register
Name
Address
Default Value
Access
FEE1STA
0xFFFFF880
0x0000
R
Table 46. FEE1MOD Register
Name
Address
Default Value
Access
FEE1MOD
0xFFFFF884
0x80
R/W
Table 47. FEE1CON Register
Name
Address
Default Value
Access
FEE1CON
0xFFFFF888
0x00
R/W
Table 48. FEE1DAT Register
Name
Address
Default Value
Access
FEE1DAT
0xFFFFF88C
0xXXXX
R/W
FEE1DAT is a 16-bit data register.
Table 49. FEE1ADR Register
Name
Address
Default Value
Access
FEE1ADR
0xFFFFF890
0x0000
R/W
FEE1ADR is a 16-bit address register.
Table 50. FEE1SGN Register
Name
Address
Default Value
Access
FEE1SGN
0xFFFFF898
0xFFFFFF
R
FEE1SGN is a 24-bit code signature.
Table 51. FEE1PRO Register
Name
Address
Default Value
Access
FEE1PRO
0xFFFFF89C
0x00000000
R/W
FEE1PRO provides protection following subsequent reset MMR.
It requires a software key (see Table 57).
Table 52. FEE1HID Register
Name
Address
Default Value
Access
FEE1HID
0xFFFFF8A0
0xFFFFFFFF
R/W
FEE1HID provides immediate protection MMR. It does not
require any software keys (see Table 57).
Command Sequence for Executing a Mass Erase
FEE0DAT = 0x3CFF;
FEE0ADR = 0xFFC3;
FEE0MOD = FEE0MOD|0x8; //Erase key enable
FEE0CON = 0x06;
//Mass erase
command
Table 53. FEExSTA MMR Bit Descriptions
Bit
Description
[15:6]
Reserved.
5
Reserved.
4
Reserved.
3
Flash/EE interrupt status bit.
Set automatically when an interrupt occurs, that is, when a command is complete and the Flash/EE interrupt enable bit in the
FEExMOD register is set.
Cleared when reading the FEExSTA register.
2
Flash/EE controller busy.
Set automatically when the controller is busy.
Cleared automatically when the controller is not busy.
1
Command fail.
Set automatically when a command completes unsuccessfully.
Cleared automatically when reading the FEExSTA register.
0
Command complete.
Set by MicroConverter when a command is complete.
Cleared automatically when reading the FEExSTA register.
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