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參數(shù)資料
| 型號： | TMX320C6201 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Digital Signal Processors(1600MIPS at 200MHz，8個功能單元并行操作的DSP) |
| 中文描述： | 數(shù)字信號處理器（1600MIPS在200MHz，8個功能單元并行操作的數(shù)字信號處理器） |
| 文件頁數(shù)： | 33/72頁 |
| 文件大?。?/td> | 1552K |
| 代理商： | TMX320C6201 |
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TMX320C6201
DIGITAL SIGNAL PROCESSOR
SPRS051B – JANUARY 1997 – REVISED JUNE 1997
33
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
clock characteristics and timing (continued)
Table 6. PLL-Component-Selection Table
CYCLE
TIME
(ns)
CLKMODE
CLKIN
(MHz)
CLKOUT1
(MHz)
R1 (
)
C1 (
μ
F)
C2 (pF)
EMI FILTER
(PART NO.)
LOCK TIME
(
μ
s)
5
5
x4
x2
50
100
200
200
16.9
16.9
.15
.068
2700
1500
TDK #153
TDK #153
59
28
5.5
5.5
x4
x2
45.5
90.9
181.8
181.8
13.7
13.7
.18
0.82
3900
1800
TDK #153
TDK #153
49
23
6
6
x4
x2
41.6
83.3
166.7
166.7
17.4
17.4
.15
.082
3300
1500
TDK #153
TDK #153
68
36
6.5
6.5
x4
x2
38.5
76.9
153.8
153.8
16.2
16.2
.18
.082
3900
1800
TDK #153
TDK #153
70
33
7
7
x4
x2
35.7
71.4
142.9
142.9
15
15
.22
.1
3900
2200
TDK #153
TDK #153
72
34
7.5
7.5
x4
x2
33.3
66.7
133.3
133.3
16.2
16.2
.22
.1
3900
2200
TDK #153
TDK #153
84
40
8
8
x4
x2
31.3
62.5
125
125
14
14
.27
.12
4700
2700
TDK #153
TDK #153
77
36
8.5
8.5
x4
x2
29.4
58.8
117.7
117.7
11.8
11.8
.33
.15
6800
3300
TDK #153
TDK #153
67
32
9
9
x4
x2
27.7
55.6
111.1
111.1
11
11
.39
.18
6800
3900
TDK #153
TDK #153
68
33
9.5
9.5
x4
x2
26.3
52.6
105.3
105.3
10.5
10.5
.39
.22
8200
3900
TDK #153
TDK #153
65
35
10
10
x4
x2
25
50
100
100
10
10
.47
.22
8200
4700
TDK #153
TDK #153
68
33
For CLKMODE = x1, the PLL is bypassed and the choice of the external component values is irrelevant and the PLLV, PLLF, and PLLG inputs
can be unconnected. The PLLFREQ inputs should be driven at all times (for CLKMODE = x1 they can be connected to GND).
Under some operating conditions, the maximum PLL lock time can vary as much as 150% from the specified typical value. For example, if the
typical lock time is specified as 100 s, its maximum value can be as long as 250
s.
P
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