- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383723 > OR3TP12-6BA352 Quad 2.3V 10 MHz OP, I temp, -40C to +85C, 14-PDIP, TUBE PDF資料下載
參數(shù)資料
| 型號(hào)： | OR3TP12-6BA352 |
| 英文描述： | Quad 2.3V 10 MHz OP, I temp, -40C to +85C, 14-PDIP, TUBE |
| 中文描述： | 用戶可編程ASIC的特殊功能 |
| 文件頁數(shù)： | 68/128頁 |
| 文件大小： | 2450K |
| 代理商： | OR3TP12-6BA352 |
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ORCAOR3TP12 FPSC
Embedded Master/Target PCI Interface
Data Sheet
March 2000
68
L Lucent Technologies Inc.
PCI Bus Core Target Controller Detailed Description
(continued)
Example: Target Read from Configuration Space
Figure 23 shows the timing on the PCI interface for a Target read from configuration space. Accesses of configura-
tion space occurs without any involvement of the FPGA interface. All configuration space accesses are discon-
nected with data on the first data word, and are thus restricted from bursting. Address decode speed is medium,
and the PCI bus core signals that it is supplying the word of data by asserting
trdyn
one cycle after
devseln
is
asserted.
5-7375(F)
Figure 23. Target Configuration Read (PCI Bus, 32-Bit)
T0
T1
T2
T3
T4
T5
T6
ADDRESS
DATA
CFG RD
BYTE ENABLES
clk
framen
ad
c_ben
idsel
irdyn
devseln
trdyn
stopn
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| OR3TP12-6BA352I | Quad 2.3V 10 MHz OP, I temp, -40C to +85C, 14-TSSOP, TUBE |
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| OR3TP12-6PS240I | Quad 2.3V 10 MHz OP, I temp, -40C to +85C, 14-SOIC 150mil, T/R |
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參數(shù)描述 |
|---|---|
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