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參數(shù)資料
| 型號(hào)： | SYM53C825AE |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 114/225頁 |
| 文件大?。?/td> | 1237K |
| 代理商： | SYM53C825AE |
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SCSI Operating Registers
5-40
SYM53C825A/825AE Data Manual
Bit 3
SGE (SCSI Gross E rror)
T he following conditions are considered SCSI
Gross Errors:
1. Data underflow - the SCSI FIFO was read
when no data was present.
2. Data overflow - the SCSI FIFO was
written to while full.
3. Offset underflow - in target mode, a
SACK / pulse was received before the
corresponding SREQ/ was sent.
4. Offset overflow - in initiator mode, an
SREQ/ pulse was received which caused
the maximum offset (Defined by the MO3-
0 bits in the SX FER register) to be
exceeded.
5. In initiator mode, a phase change occurred
with an outstanding SREQ/SACK offset.
6. Residual data in SCSI FIFO - a transfer
other than synchronous data receive was
started with data left in the SCSI
synchronous receive FIFO.
Bit 2
UDC (Unexpected Disconnect)
T his condition only occurs in initiator mode. It
happens when the target to which the
SYM53C825A is connected disconnects from
the SCSI bus unexpectedly. See the SCSI Dis-
connect Unexpected bit in the SCNT L2 regis-
ter for more information on expected versus
unexpected disconnects. Any disconnect in low
level mode causes this condition.
Bit 1
RST (SCSI Reset Condition)
T he SRST / signal has been asserted by the
SYM53C825A or any other SCSI device. T his
condition is edge-triggered, so multiple inter-
rupts cannot occur because of a single SRST /
pulse.
Bit 0
PAR (SCSI Parity E rror)
T he SYM53C825A detected a parity error
while receiving or sending SCSI data. See the
Disable Halt on Parity Error or SAT N/ Condi-
tion bits in the SCNT L1 register for more
information on when this condition will actu-
ally be raised.
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PDF描述 |
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