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參數(shù)資料
| 型號： | sda 9206 |
| 廠商： | SIEMENS AG |
| 英文描述： | ADC with Built in Antialiasing Filter and Clock Generation Unit(帶有片內(nèi)去混疊和時鐘發(fā)生器的A/D轉(zhuǎn)換器) |
| 中文描述： | 在抗混疊濾波器和時鐘產(chǎn)生單元內(nèi)置模數(shù)轉(zhuǎn)換器（帶有片內(nèi)去混疊和時鐘發(fā)生器的的A / D轉(zhuǎn)換器） |
| 文件頁數(shù)： | 39/54頁 |
| 文件大?。?/td> | 530K |
| 代理商： | SDA 9206 |
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SDA 9206
Semiconductor Group
39
1999-02-10
Subaddress 0F
H
Bit
D7...D0
Subaddress 10
H
Bit
D7...D4
Subaddress 11
H
Bit
D7...D4
Name
0000 0000 Reserved
Function
Name
FION
Function
Start of clock frequency freezing in number of lines before
the vertical pulse (only valid for 2FH = 0):
0000:
0 (no freezing)
0001:
1
:
:
1111:
15
Duration of clock frequency freezing in number of lines:
0000:
0 (no freezing)
0001:
1
:
:
1111:
15
D3...D0
FILE
Name
SYNAMP Internal amplification of SYNC input signal.
Allowed values:
SYNAMP = 0000 : amplification 0 dB : SYNC input nom. 2 Vpp
SYNAMP = 0110 : amplification 6 dB : SYNC input nom. 1 Vpp
YAMP
Internal amplification of AINY input signal.
Allowed values:
YAMP = 0000 : amplification 0 dB : AINY input nom. 2 Vpp
YAMP = 0110 : amplification 6 dB : AINY input nom. 1 Vpp
Function
D3...D0
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