參數(shù)資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 78/366頁
文件大小： 0K
描述： IC TDM OVER PACKET 484TEBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 30
類型： TDM（分時復(fù)用）
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
169 of 366
Packet_classifier_cfg_reg3 0x44
Bits
Data Element Name
R/W
Reset
Value
Description
[16]
Discard_switch_0
R/W
0x0
ARP packets whose IP destination address does not
match chip’s addresses. See section 10.6.13.
0 = Forward to CPU
1 = Discard
[15:0]
MAC_add1
R/W
0x0000
This field holds bits 47:32 of the first of two MAC
addresses for the device. The lower bits of this MAC
address are in
MAC address is in Packet_classifier_cfg_reg5 and
Packet_classifier_cfg_reg6. Relevant only for packets
received from Ethernet port.
Packet_classifier_cfg_reg4 0x48
Bits
Data Element Name
R/W
Reset
Value
Description
[31:16]
TDMoIP_port_num2
R/W
0x085E
Packets with UDP destination port number equal to this
field are recognized as TDMoIP packets. See section
[15:0]
TDMoIP_port_num1
R/W
0x085E
Packets with UDP destination port number equal to this
field are recognized as TDMoIP packets. See section
Packet_classifier_cfg_reg5 0x4C
Bits
Data Element Name
R/W
Reset
Value
Description
[31:0]
MAC_add2
R/W
0x0
This field holds bits 31:0 of the second of two MAC
addresses for the device. The upper bits of this MAC
address are in Packet_classifier_cfg_reg6. The other
MAC address is in
Packet_classifier_cfg_reg3. Relevant only for packets
received from Ethernet port.
Packet_classifier_cfg_reg6 0x50
Bits
Data Element Name
R/W
Reset
Value
Description
[31:16]
Ip_udp_bn_mask_n
R/W
0x0000
This mask Indicates the width of the bundle identifier. For
example, if the desired width is 8 bits, the following should
be written to this field: 0000000011111111b. See section
[15:0]
MAC_add2
R/W
0x0000
This field holds bits 47:32 of the second of two MAC
addresses for the device. The lower bits of this MAC
address are in
Packet_classifier_cfg_reg5. The other
MAC address is in
Packet_classifier_cfg_reg3. Relevant only for packets
received from Ethernet port.
Packet_classifier_cfg_reg7 0x54
Bits
Data Element Name
R/W
Reset
Value
Description
[31:16]
CPU_dest_ether_type
R/W
0x0800
Ethertype which identifies packets destined for the CPU.
Such packets are sent to CPU or discarded as specified
by
3
Packet_classifier_cfg_reg3.Discard_switch_[8:0].
This field must be set to a value greater than 0x5DC. See
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DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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