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參數(shù)資料
| 型號： | SYM53C810A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 67/188頁 |
| 文件大?。?/td> | 1120K |
| 代理商： | SYM53C810A |
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Operating Registers
SYM53C810A Data Manual
5-9
Register 02 (82)
SCSI Control Two (SCNT L2)
Read/Write
Bit 7
SDU (SCSI Disconnect Unexpected)
T his bit is valid in initiator mode only. When
this bit is set, the SCSI core is not expecting
the SCSI bus to enter the Bus Free phase. If it
does, an unexpected disconnect error will be
generated (see the Unexpected Disconnect bit
in the SIST 0 register, bit 2). During normal
SCRIPT S mode operation, this bit is set auto-
matically whenever the SCSI core is reselected,
or successfully selects another SCSI device.
T he SDU bit should be reset with a register
write (
MOVE 0X 7f & SCNTL2 TO SCNTL2
)
before the SCSI core expects a disconnect to
occur, normally prior to sending an Abort,
Abort Tag, Bus Device Reset, Clear Queue or
Release Recovery message, or before deassert-
ing SACK / after receiving a Disconnect com-
mand or Command Complete message.
Bits 6-0 Reserved
Register 03 (83)
SCSI Control T hree (SCNT L3)
Read/Write
Bit 7
Reserved
Bits 6-4 SCF2-0 (Synchronous Clock
Conversion Factor)
T hese bits select the factor by which the fre-
quency of SCLK is divided before being pre-
sented to the synchronous SCSI control logic.
T he bits are encoded as per Table 5-2, “Syn-
chronous Clock Conversion Factor,” on
page 5-10. For synchronous receive, the output
of this divider is always divided by 4 and that
value determines the transfer rate. For exam-
ple, if SCLK is 40 MHz and the SCF value is
set to divide by one, then the maximum syn-
chronous receive rate is 10 Mb/s
.
40 1
4
10
=
(
For synchronous send, the output of this
divider gets divided by the transfer period
(X FERP) bits in the SCSI Transfer (SX FER)
register, and that value determines the transfer
SDU
7
Default>>>
0
RES
6
RES
5
RES
4
RES
3
RES
2
RES
1
RES
0
X
X
X
X
X
X
X
RES
7
SCF2
6
SCF1
5
SCF0
4
RES
3
CCF2
2
CCF1
1
CCF0
0
Default>>>
X
0
0
0
X
0
0
0
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PDF描述 |
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