參數(shù)資料
型號(hào)： ML60852A
廠商： LAPIS SEMICONDUCTOR CO LTD
元件分類： 總線控制器
英文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP44
封裝： PLASTIC, QFP-44
文件頁數(shù)： 73/82頁
文件大?。?/td> 370K
代理商： ML60852A
FEDL60852A-03
1Semiconductor
ML60852A
74/81
DMA Transfer Timing (3)
ML60852A to Memory (Demand Transfer, Single Address Mode)
Parameter
Symbol
Condition
Min.
Max.
Unit
Note
DREQ Disable Time
t
1
Load 20 pF
—
20
ns
DACK Hold Time
t
2
0—
ns
Read Data Delay Time
t
3
Load 20 pF
—
46
ns
(1)
Data Hold Time
t
4
0—
ns
8-bit DMA
63
—
ns
(2)
Recovery Time
t
5
16-bit DMA
105
—
ns
(3)
Notes: (1) When in Single Address mode, t
3 is defined depending on DACK or RD which becomes
active last.
A6: A0 and
CS are ignored.
(2) 3-clock time of oscillation clock (clock period: 21 ns).
(3) 5-clock time of oscillation clock (clock period: 21 ns).
Last Packet Read
,4-3
DOUT
4,
DACK
t4
t3
t5
t2
t1
RD
DREQ
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PDF描述
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