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參數(shù)資料
| 型號： | ML60852A |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封裝： | PLASTIC, QFP-44 |
| 文件頁數(shù)： | 49/82頁 |
| 文件大?。?/td> | 370K |
| 代理商： | ML60852A |
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FEDL60852A-03
1Semiconductor
ML60852A
52/81
EP1, 2, 3, 4, 5 Configuration Registers (EP1, 2, 3, 4, 5CONF)
Address
0 x 41 to 45
Type
Bit map
Access type
Read only
D7
D6
D5
D4
D3
D2
D1
D0
After a hardware reset
0
0000
00
After a bus reset
0
0100
00
Definition
0
Transfer type:
These bits indicate the type of transfer. Only EP4 and EP5 can be set to isochronous transfer.
Configuration bit:
When a Set Configuration request to make that EP active is received from the host, make sure
that the local MCU writes a “1” into this bit during the status stage in the control
transfermode.
Data transmission and reception can be made between the host and the EP when this bit is “1”.
When this bit is “0”, this LSI will not respond to the transactions targeted at that EP.
Transfer direction:
The local MCU sets the direction of data transfer using this bit.
Transfer type
10 = Bulk transfer
11 = Interrupt transfer
01 = Isochronous
transfer
Configuration bit
Transfer direction
0=Reception,
1=transmission
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參數(shù)描述 |
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