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參數(shù)資料
| 型號： | M30956FKTGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 288/579頁 |
| 文件大?。?/td> | 12750K |
| 代理商： | M30956FKTGP |
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22. 16-Slot CAN Module
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22.1.1.1 RESET1 and RESET0 Bits
When both bits RESET1 and RESET0 are set to 1 (CAN module is reset), the CAN module is immediately reset
regardless of ongoing CAN communication.
After both bits RESET1 and RESET0 are set to 1 and the CAN module reset is completed, the CiTSR register
(i = 0, 1) becomes 0000h. Also, registers CiTEC and CiREC become 00h and both bits STATE_ERRPAS and
STATE_BUSOFF in the CiSTR register become 0.
When both bits RESET1 and RESET0 are changed from 1 to 0, the CiTSR register starts counting. The CAN
module is permitted to communicate after 11 consecutive recessive bits have been detected.
NOTES:
1. Set the same value in bits RESET1 and RESET0 simultaneously.
2. Ensure that the STATE_RESET bit in the CiSTR register becomes 1 (CAN module is in reset) after both
bits RESET1 and RESET0 are set to 1.
3. The CANiOUT pin outputs a high-level (“H”) signal as soon as bits RESET1 and RESET0 are set to 1.
CAN bus error may occur by setting both bits RESET1 and RESET0 to 1 while the CAN frame is being
transmitted.
4. To select pins CANiIN and CANiOUT for CAN communication, set registers PS1, PS2, PS3, PSL1,
PSL2, PSL3, PSC, PSC2, PSC3, IPS, IPSA, PD7, PD8, and PD9 while the STATE_RESET bit is 1 (CAN
module is in reset).
22.1.1.2 LOOPBACK Bit
When the LOOPBACK bit is set to 1 (loopback function enabled) and the receive message slot has the
identifier (ID) and frame format matched with a transmitted frame, the transmitted frame is stored to the receive
message slot.
NOTES:
1. No ACK for the transmitted frame is returned.
2. Change the LOOPBACK bit setting while the STATE_RESET bit is 1 (CAN module is in
reset).
22.1.1.3 BASICCAN Bit
When the BASICCAN bit is set to 1, the message slots 14 and 15 enter BasicCAN mode.
In BasicCAN mode, the message slots 14 and 15 can be used as dual-structured buffers.
Acceptance filtering permits the receive frames having the matching IDs to be stored into the message slots 14
and 15 alternately. Both data frame and remote frame can be received.
Use the following procedure to enter BasicCAN mode.
(1) Set the BASICCAN bit to 1.
(2) Set the same ID to the message slots 14 and 15.
(3) Set the same values in registers CiLMAR0 to CiLMAR4 and CiLMBR0 to CiLMBR4.
(4) Set the same value to bits IDE14 and IDE15 in the CiIDR register.
(5) Set registers CiMCTL14 and CiMCTL15 to receive a data frame.
NOTES:
1. Change the BASICCAN bit setting while the STATE_RESET bit is 1 (CAN module is in reset).
2. The message slot 14 is the first slot to become active after bits RESET1 and RESET0 are set to 0.
3. The settings to enter BasicCAN mode has no affect on the message slot 0 to 13.
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