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參數(shù)資料
| 型號： | UPD703130GC-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 66/72頁 |
| 文件大?。?/td> | 601K |
| 代理商： | UPD703130GC-8EU |
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Preliminary Data Sheet U15390EJ1V0DS
66
μ
PD703130
(12) CSI0, CSI1 timing
(a) Master mode
Parameter
Symbol
Condition
MIN.
MAX.
Unit
SCKn cycle
<147>
t
CYSK1
Output
100
ns
SCKn high-level width
<148>
t
WSK1H
Output
0.5t
CYSK1
– 20
ns
SCKn low-level width
<149>
t
WSK1L
Output
0.5t
CYSK1
– 20
ns
SIn setup time (to SCKn
↑
)
<150>
t
SSISK
30
ns
SIn hold time (from SCKn
↑
)
<151>
t
HSKSI
0
ns
SOn output delay time (from SCKn
↓
)
<152>
t
DSKSO
20
ns
SOn output hold time (from SCKn
↑
)
<153>
t
HSKSO
0.5t
CYSK1
– 5
ns
Remark
n = 0, 1
(b) Slave mode
Parameter
Symbol
Condition
MIN.
MAX.
Unit
SCKn cycle
<147>
t
CYSK1
Input
100
ns
SCKn high-level width
<148>
t
WSK1H
Input
30
ns
SCKn low-level width
<149>
t
WSK1L
Input
30
ns
SIn setup time (to SCKn
↑
)
<150>
t
SSISK
10
ns
SIn hold time (from SCKn
↑
)
<151>
t
HSKSI
10
ns
SOn output delay time (from SCKn
↓
)
<152>
t
DSKSO
30
ns
SOn output hold time (from SCKn
↑
)
<153>
t
HSKSO
t
WSK1H
ns
Remark
n = 0, 1
SCKn (I/O)
<149>
<147>
<148>
Sln (Input)
<150>
<151>
Input data
SOn (Output)
<152>
Output data
<153>
Remarks 1.
The broken lines indicate high impedance.
2.
n = 0, 1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD703130 | MOS INTEGRATED CIRCUIT |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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