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參數(shù)資料
| 型號： | UPD703130GC-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 45/72頁 |
| 文件大?。?/td> | 601K |
| 代理商： | UPD703130GC-8EU |
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Preliminary Data Sheet U15390EJ1V0DS
45
μ
PD703130
(d) Write timing (high-speed page DRAM access: on-page) (2/2)
TCPW
TO1
TDAW
TO2
<58>
<59>
<63>
<64>
<83>
<81>
<65>
<89>
<88>
<84>
<85>
<92>
<91>
<86>
<87>
<90>
CLKOUT (Output)
A0 to A23 (Output)
RASn (Output)
UCAS (Output)
LCAS (Output)
OE (Output)
WE (Output)
D0 to D15 (I/O)
WAIT (Input)
Column address
Remarks 1.
This is the timing for the following case (n = 0 to 3, xx = 00 to 03, 10 to 13).
Number of waits due to the CPCxx bit of the DRCn register (TCPW ): 1
Number of waits due to the DACxx bit of the DRCn register (TDAW): 1
2.
The broken lines indicate high impedance.
3.
n = 3 to 5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD703130 | MOS INTEGRATED CIRCUIT |
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參數(shù)描述 |
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