參數(shù)資料
型號(hào)： UPD703130GC-8EU
廠商： NEC Corp.
英文描述： MOS INTEGRATED CIRCUIT
中文描述： 馬鞍山集成電路
文件頁數(shù)： 47/72頁
文件大小： 601K
代理商： UPD703130GC-8EU
Preliminary Data Sheet U15390EJ1V0DS
47
μ
PD703130
(e) Read timing (EDO DRAM) (2/3)
Parameter
Symbol
Condition
MIN.
MAX.
Unit
Off-page
<99>
t
OEA1
(2 + w
RP
+ w
RH
+ w
DA
)T
– 28
ns
Output enable access
time
On-page
<100>
t
OEA2
(1 + w
CP
+ w
DA
)
T –
28
ns
Remarks 1.
T = t
CYK
2.
w
RP
: The number of waits due to the RPCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
3.
w
RH
: The number of waits due to the RHCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10
to 13).
4.
w
DA
: The number of waits due to the DACxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
5.
w
CP
: The number of waits due to the CPCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
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