參數(shù)資料
型號： TMS320F28335_1
廠商： Texas Instruments, Inc.
英文描述： Variable Capacitance Diode for TV Tuner VHF Tuning; Ratings VR (V): 32; Characteristics n: 12.0 min; Characteristics rs (ohm) max: 0.85; Characteristics C (pF) max: C2 = 32.2 to 37.5 C25 = 2.57 to 3.0; Characteristics CVR/CVR: 2/25; Cl: 2.777; Package: UFP
中文描述： 數(shù)字信號控制器（DSC）
文件頁數(shù)： 116/166頁
文件大小： 1889K
代理商： TMS320F28335_1
www.ti.com
A
6.7
Clock Requirements and Characteristics
TMS320F28335, TMS320F28334, TMS320F28332
Digital Signal Controllers (DSCs)
SPRS439B–JUNE 2007–REVISED OCTOBER 2007
Table 6-7. Input Clock Frequency
PARAMETER
Resonator (X1/X2)
Crystal (X1/X2)
MIN
20
20
TYP
MAX
UNIT
35
35
150
100
f
x
Input clock frequency
MHz
150-MHz device
100-MHz device
4
4
External oscillator/clock
source (XCLKIN or X1 pin)
f
l
Limp mode SYSCLKOUT frequency range (with /2 enabled)
1 - 5
MHz
Table 6-8. XCLKIN
(1)
Timing Requirements - PLL Enabled
NO.
C8
C9
C10
C11
C12
MIN
33.3
MAX
200
UNIT
ns
ns
ns
%
%
t
c(CI)
t
f(CI)
t
r(CI)
t
w(CIL)
t
w(CIH)
Cycle time, XCLKIN
Fall time, XCLKIN
Rise time, XCLKIN
Pulse duration, XCLKIN low as a percentage of t
c(OSCCLK)
Pulse duration, XCLKIN high as a percentage of t
c(OSCCLK)
6
6
45
45
55
55
(1)
This applies to the X1 pin also.
Table 6-9. XCLKIN
(1)
Timing Requirements - PLL Disabled
NO.
C8
MIN
6.67
10
MAX
250
250
UNIT
ns
t
c(CI)
Cycle time, XCLKIN
150-MHz device
100-MHz device
Up to 30 MHz
30 MHz to 150 MHz
Up to 30 MHz
30 MHz to 150 MHz
C9
t
f(CI)
Fall time, XCLKIN
6
2
6
2
ns
ns
ns
ns
%
%
C10
t
r(CI)
Rise time, XCLKIN
C11
C12
t
w(CIL)
t
w(CIH)
Pulse duration, XCLKIN low as a percentage of t
c(OSCCLK)
Pulse duration, XCLKIN high as a percentage of t
c(OSCCLK)
45
45
55
55
(1)
This applies to the X1 pin also.
The possible configuration modes are shown in
Table 3-18
.
Table 6-10. XCLKOUT Switching Characteristics (PLL Bypassed or Enabled)
(1)(2)
NO.
PARAMETER
MIN
6.67
10
TYP
MAX
UNIT
150-MHz device
100-MHz device
C1
t
c(XCO)
Cycle time, XCLKOUT
ns
C3
C4
C5
C6
t
f(XCO)
t
r(XCO)
t
w(XCOL)
t
w(XCOH)
t
p
Fall time, XCLKOUT
Rise time, XCLKOUT
Pulse duration, XCLKOUT low
Pulse duration, XCLKOUT high
PLL lock time
2
2
ns
ns
ns
ns
H – 2
H – 2
H + 2
H + 2
131072t
c(OSCCLK)
(3)
cycles
(1)
(2)
(3)
A load of 40 pF is assumed for these parameters.
H = 0.5t
OSCCLK is either the output of the on-chip oscillator or the output from an external oscillator.
Electrical Specifications
116
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