參數(shù)資料
型號： MC145574
廠商： Motorola, Inc.
英文描述： ISDN S/T-Interface Transceiver
中文描述： 綜合業(yè)務數(shù)字網(wǎng)S / T的接口收發(fā)器
文件頁數(shù)： 126/164頁
文件大?。?/td> 1072K
代理商： MC145574
MC145574
18–4
MOTOROLA
Ref. No.
Parameter
Min
Max
Unit
Note
14
FSC Period
125
—
μ
s
1
15
FSC High Before the Falling Edge of DCL (FSC Setup Time)
25
—
ns
16
FSC High After the Falling Edge of DCL (FSC Hold Time)
25
—
ns
17
Delay From Rising Edge of DCL to Low–Z and Valid Data on
Dout
—
30
ns
18
Delay From Rising Edge of DCL to Data Valid on Dout
Delay From Rising Edge of DCL to High–Z on Dout
Delay From Rising Edge of DCL to TSEN Low
—
30
ns
19
5
30
ns
20
—
30
ns
2
21
Delay From Rising Edge of DCL to TSEN High
—
30
ns
22
DCL Clock Period
244
1953
ns
3
23
DCL Pulse Width High
45
55
% of DCL
Period
24
DCL Pulse Width Low
45
55
% of DCL
Period
25
Data Valid on Din Before Falling Edge of DCL (Din Setup Time)
Data Valid on Din After Falling Edge of DCL (Din Hold Time)
25
—
ns
26
25
—
ns
NOTES:
1. FSC occurs on average every 125
μ
s. FSC must occur every 125
μ
s with a maximum instantaneous phase titter of
±
30
μ
s.
2. In IDL2 8– and 10–bit formats, TSEN is valid during the B1, B2, and D channel timeslots. TSEN will be aligned with data
on the Dout pin.
3. In IDL2 Slave mode, DCL may be any frequency multiple of 8 kHz between 256 kHz and 4.096 MHz inclusive.
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
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MC145574AEG 制造商:Freescale Semiconductor 功能描述:
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