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參數資料
| 型號： | UPD178F098GF-3BA-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數： | 463/559頁 |
| 文件大?。?/td> | 3587K |
| 代理商： | UPD178F098GF-3BA-A |
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515
CHAPTER 24
INSTRUCTION SET
User’s Manual U12790EJ2V0UD
sfr.bit, $addr16
4
–
12
A.bit, $addr16
3
8
–
PSW.bit, $addr16
4
–
12
×× ×
[HL].bit, $addr16
3
10
12
B, $addr16
2
6
–
C, $addr16
2
6
–
saddr. $addr16
3
8
10
Mnemonic
Operands
Bytes
Operation
Instruction
Group
CPU
control
Conditional
branch
Clocks
Flag
Note 1
Note 2
ZAC CY
BT
saddr.bit, $addr16
3
8
9
PC
← PC + 3 + jdisp8 if(saddr.bit) = 1
sfr.bit, $addr16
4
–
11
PC
← PC + 4 + jdisp8 if sfr.bit = 1
A.bit, $addr16
3
8
–
PC
← PC + 3 + jdisp8 if A.bit = 1
PSW.bit, $addr16
3
–
9
PC
← PC + 3 + jdisp8 if PSW.bit = 1
[HL].bit, $addr16
3
10
11
PC
← PC + 3 + jdisp8 if (HL).bit = 1
BF
saddr.bit, $addr16
4
10
11
PC
← PC + 4 + jdisp8 if(saddr.bit) = 0
sfr.bit, $addr16
4
–
11
PC
← PC + 4 + jdisp8 if sfr.bit = 0
A.bit, $addr16
3
8
–
PC
← PC + 3 + jdisp8 if A.bit = 0
PSW.bit, $addr16
4
–
11
PC
← PC + 4 + jdisp8 if PSW. bit = 0
[HL].bit, $addr16
3
10
11
PC
← PC + 3 + jdisp8 if (HL).bit = 0
BTCLR
saddr.bit, $addr16
4
10
12
PC
← PC + 4 + jdisp8 if(saddr.bit) = 1
then reset(saddr.bit)
PC
← PC + 4 + jdisp8 if sfr.bit = 1
then reset sfr.bit
PC
← PC + 3 + jdisp8 if A.bit = 1
then reset A.bit
PC
← PC + 4 + jdisp8 if PSW.bit = 1
then reset PSW.bit
PC
← PC + 3 + jdisp8 if (HL).bit = 1
then reset (HL).bit
DBNZ
B
← B – 1, then
PC
← PC + 2 + jdisp8 if B ≠ 0
C
← C –1, then
PC
← PC + 2 + jdisp8 if C ≠ 0
(saddr)
← (saddr) – 1, then
PC
← PC + 3 + jdisp8 if(saddr) ≠ 0
SEL
RBn
2
4
–
RBS1, 0
← n
NOP
1
2
–
No Operation
EI
2
–
6
IE
← 1(Enable Interrupt)
DI
2
–
6
IE
← 0(Disable Interrupt)
HALT
2
6
–
Set HALT Mode
STOP
2
6
–
Set STOP Mode
Notes 1. When the internal high-speed RAM area is accessed or an instruction with no data access
2. When an area except the internal high-speed RAM area is accessed
Remarks 1. One instruction clock cycle is one cycle of the CPU clock (fCPU) selected by the PCC register.
2. This clock cycle applies to the internal ROM program.
相關PDF資料 |
PDF描述 |
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參數描述 |
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