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參數(shù)資料
| 型號： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 3/145頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
100
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
7
Enable staging S3, S4, or S5 state waiting for Stop Grant. When set the
power management unit will wait for the stop grant cycles before transi-
tioning into the S3, S4, or S5 state.
R/W
0
6
Enable staging S1 sleep state waiting for Stop Grant When set the power
management unit will wait for the stop grant cycles before transitioning
into the S1 state.
R/W
0
5:3
THRM_DTY. Thermal Throttle Duty Cycle. Selects the duty cycle of
H_STPCLK# during Clock Control Thermal Throttling mode (H_THRM#
asserted).
000: Reserved
001: 12.5%
010: 25.0%
011: 37.5%
100: 50.0%
101: 62.5%
110: 75.0%
111: 87.5%
R/W
000b
2
THRM_POL. H_THRM# Polarity. When set, active LOW H_THRM# asser-
tion sets the THRM_STS bit. When Clear, active HIGH H_THRM# assertion
sets the THRM_STS bit.
R/W
0
1
BIOS_RLS. BIOS Release. When set, an SCI will be generated and GBL_STS
bit will be set, if enabled by the GBL_EN bit. When Clear, no SCI or clear
of GBL_STS. This bit is used by BIOS software to raise an event to the
ACPI software.
R/W
0
SMI_EN. SMI Enable. When set, SMI# is generated upon any enabled
SMI# event. This bit is cleared by a P_RST#.
R/W
0
Global State Register
ADDRESS: ACPI_BASE + 28h
SYMBOL: GLBSTS
BITS
DESCRIPTION
PROPERTIES
RESET
NOTES
31:7
Reserved.
R/O
0
1
8
Power Button State. Current state of PWR_BUTTON# pin.
R/O
0
1
7
External RTC alarm/interrupt enable. When set, IRQ8 and the
RTC events in power management are routed from
GPIO_VAUX[15]. GPIO_VAUX[15] must be enabled as input
only for this to function.
R/W
0
2
6
Suspend from Mechanical Off. Determines the state that the
system will enter from mechanical off. If set, the system will
enter S5 state. If clear, the system will enter S0 state.
R/W
0
1
5
Global Timer Base. This field determines the granularity of
the Global Power Management Timer. When set, the timer is
32 bits. When clear, the timer is 24 bits.
R/W
0
2
Global Control Register (continued)
ADDRESS: ACPI_BASE + 24h
SYMBOL: GLBCTRL
BITS
DESCRIPTION
PROPERTIES
RESET
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