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參數(shù)資料
| 型號： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 139/145頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
93
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
Power Management 1 Timer Register
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
Processor Control Register
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
Level 2 Register
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
ADDRESS: ACPI_BASE + 08h
SYMBOL: PM1_TMR
BITS
DESCRIPTION
PROPERTIES
RESET
31:24
E_TMR_VAL. Extended Timer Value. This R/O field returns the upper
eight bits of a 32-bit power management timer if the 32-bit timer is
enabled, otherwise it returns zeros.
R/O
0
23:0
TMR_VAL. Timer Value. This R/O field returns the running count of the
power management timer. This timer runs at 3.579545 MHz and counts
while in S0 or S1 system state.
R/O
0
ADDRESS: ACPI_BASE + 0Ch
SYMBOL: P_CTRL
BITS
DESCRIPTION
PROPERTIES
RESET
31:5
Reserved.
R/O
0
4
THT_EN. Throttle Enable. Set enables system throttle clock control. This
bit must be cleared when changing the THTL_DUTY.
R/W
0
3:1
THTL_DUTY. Throttle Duty. Selects the duty cycle of H_STPCLK# when the
system is in system throttling mode.
000: Reserved
001: 12.5%
010: 25.0%
011: 37.5%
100: 50.0%
101: 62.5%
110: 75.0%
111: 87.5%
R/W
000b
0Reserved.
R/W
0
ADDRESS: ACPI_BASE + 10h
SYMBOL: LVL2
BITS
DESCRIPTION
PROPERTIES
RESET
7:0
LVL2. Level 2 Power State Entry. Reads to this register will return zeros
and cause the CPU power management controller to enter C2 state.
Writes have no effect.
R/O
0
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參數(shù)描述 |
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