參數(shù)資料
型號: MPC105
廠商: MOTOROLA INC
元件分類: 存儲控制器/管理單元
英文描述: 32-Bit Microprocessor(32位微處理器)
中文描述: 1G X 8, DRAM CONTROLLER, PBGA304
封裝: BGA-304
文件頁數(shù): 130/311頁
文件大?。?/td> 1708K
代理商: MPC105
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4-12
MPC105 PCIB/MC User's Manual
MOTOROLA
4.3.2.2 TBST and TSIZ0–TSIZ2 Signals and Size of Transfer
The transfer size (TSIZ0–TSIZ2) signals, in conjunction with the transfer burst (TBST)
signal, indicate the size of the requested data transfer, as shown in Table 4-3. These signals
may be used along with address bits A29–A31 to determine which portion of the data bus
contains valid data for a write transaction or which portion of the bus should contain valid
data for a read transaction. The 60x processors use the eight-word burst transactions for
transfer of cache blocks. For these transactions, the TSIZ0–TSIZ2 signals are encoded as
0b010, and address bits A27–A28 determine which double-word transfer should occur first.
The MPC105
supports critical-word-first burst transactions (double-word-aligned) from
the 60x processor. The MPC105 transfers this double word of data first, followed by double
words from increasing addresses, wrapping back to the beginning of the eight-word block
as required. L2 cast-out operations always start at eight-word block boundaries.
4.3.2.3 Burst Ordering During Data Transfers
During burst data transfer operations, 32 bytes of data (one cache line) are transferred to or
from the cache in order. Burst write transfers are always performed zero-double-word-first.
However, since burst reads are performed critical-double-word-first, a burst-read transfer
may not start with the first double word of the cache line, and the cache line fill operation
may wrap around the end of the cache line.
Table 4-4 describes the burst ordering when the MPC105 is configured with a 64-bit data
bus.
Table 4-3. MPC105 Transfer Size Encodings
TBST
TSIZ0
TSIZ1
TSIZ2
Transfer Size
Asserted
0
1
0
Eight-word burst
Negated
0
0
0
Eight bytes
Negated
0
0
1
One byte
Negated
0
1
0
Two bytes
Negated
0
1
1
Three bytes
Negated
1
0
0
Four bytes
Negated
1
0
1
Five bytes
Negated
1
1
0
Six bytes
Negated
1
1
1
Seven bytes
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