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參數(shù)資料
| 型號： | MC145572 |
| 廠商： | Motorola, Inc. |
| 英文描述： | ISDN U-Interface Transceiver(ISDN U接口收發(fā)器) |
| 中文描述： | 綜合業(yè)務(wù)數(shù)字網(wǎng)U型接口收發(fā)器（綜合業(yè)務(wù)數(shù)字網(wǎng)ü接口收發(fā)器） |
| 文件頁數(shù)： | 65/264頁 |
| 文件大小： | 2832K |
| 代理商： | MC145572 |
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MC145572
4–29
MOTOROLA
This read–only register contains the revision number of the particular U–interface transceiver device.
BR15 is accessed by a SCP or PCP transfer when BR7(b7) is 0 and the byte address is 15.
b7
b6
b5
b4
b3
b2
b1
b0
BR15
Mask 7
Mask 6
Mask 5
Mask 4
Mask 3
Mask 2
Mask 1
Mask 0
ro
ro
ro
ro
ro
ro
ro
ro
Mask 7:0
These bits allow for an electronic determination of the revision number of the MC145572 U–interface
transceiver manufacturing mask set.
This register is used to enable clock and test data outputs. All writable bits in this register are cleared
to 0 after a reset. BR15A is accessed by a CPI transfer when BR7(b7) is 1 and the byte address
in the SCP transfer is 15. The write–only bits in this register remain write–only bits when BR14(b6)
is set to 1.
CAUTION
Reserved bits b5 and b4 must be set to 0 at all times.
b7
b6
b5
b4
b3
b2
b1
b0
BR15A
FREQ
ADAPT
Jump
Disable
Reserved
Reserved
Enable
TxSFS
Reserved
Reserved
Enable
Eye Data
and Baud
Clock
wo
wo
wo
wo
wo
Reserved
Reserved
Reserved
Reserved
Reserved
rw
rw
rw
ro
ro
ro
ro
ro
FREQ ADAPT
This bit is a read/write bit. There is no effect on the operation of the U–interface transceiver unless
Control Steer (BR12 (b7)) is set to 1. When Control Steer is 1 and FREQ ADAPT is set to 1, the NT
frequency adaptation circuits are enabled to adjust the external crystal frequency. Setting this bit to
0 freezes the frequency adaptation circuits in their current state.
Jump Disable
This bit is a read/write bit. Setting this bit to 1 disables the digital PLL when Activation Control Steer
(BR12(b7)) is set to 1 (this bit is used for Motorola test purposes only).
Enable TxSFS
When set to 1 with BR14(b0) set to 1, this bit enables the transmit Superframe Sync to be output.
Enable Eye Data and Baud Clock
When set to 1, this bit enables the EYEDATA, SYSCLK, Rx BAUD CLK, and Tx BAUD CLK output
pins.
NOTE
When the MC145572 is configured for IDL2 and SCP operation the 15.36 CLKOUT,
4.096 CLKOUT, and BUFXTAL pins default to “on.” Software written for
MC145472/MC14LC5472 that set BR15A (b1 or b2) is not affected when an existing
MC145472 or MC14LC5472 product is upgraded to MC145572.
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PDF描述 |
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參數(shù)描述 |
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