參數(shù)資料
型號: MC145572
廠商: Motorola, Inc.
英文描述: ISDN U-Interface Transceiver(ISDN U接口收發(fā)器)
中文描述: 綜合業(yè)務數(shù)字網(wǎng)U型接口收發(fā)器(綜合業(yè)務數(shù)字網(wǎng)ü接口收發(fā)器)
文件頁數(shù): 35/264頁
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代理商: MC145572
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MC145572
3–13
MOTOROLA
ANSI T1.601–1992 requirements. Some ANSI and ETSI applications require a
±
32 ppm reference.
NT Mode:
In MCU/GCI = 1 mode, FREQREF can be enabled as an output when
the MC145572 is configured for NT mode by setting OR8(b4) to a 1. This signal outputs
the internally–generated DCL clock when enabled. Its frequency is programmed by
the DCL frequency bits BR7(b2) and OR7(b4).
GCI Mode:
In MCU/GCI = 0 mode, a separate pin, FREFout, provides the synchro-
nized clock and is available for all configurations except for when TxBCLK is enabled.
Use the CLKSEL pin to select between 512 kHz and 2.048 MHz in NT mode.
XTALin and XTALout: Crystal Input and Crystal Output
A 20.48 MHz pullable crystal is connected between XTALin and XTALout to form a voltage–
controlled crystal oscillator in the LT or NT modes. No other external components are required.
See
Section H.3
for information on how to characterize the pullable crystal.
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*Required for LT mode only.
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Figure 3–1. Method to Drive MC145572 with External Clock
In LT mode, an internal PLL synchronizes a voltage controlled 20.48 MHz crystal oscillator to an 8 kHz
reference frequency supplied by the switching equipment. This phase–locked clock assures that the
transmitted 2B1Q signal is synchronized to the frequency reference supplied at the FREQREF pin.
In addition, the very low frequency response (1 Hz) of the internal PLL loop filter limits jitter present
in the frequency reference.
In NT mode, the MC145572 synchronizes its DCL clock output pin to the recovered timing from the
U–interface. This clock is available at 512 kHz, 2.048 MHz, and 2.56 MHz. Frequency adjustments
are also made to the 20.48 MHz oscillator, but it is not precisely locked to the recovered 2B1Q signal
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